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参数资料
| 型号： | SL28PCIE50ALIT |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 12/16页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK PCIE GEN2 48QFN |
| 标准包装： | 2,500 |
| 系列： | EProClock® |
| 类型： | * |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:10 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 100MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
SL28PCIe50
DOC#: SP-AP-0758 (Rev. AA)
Page 5 of 16
Control Registers
Byte 0: Control Register 0
Bit
@Pup
Type
Name
Description
7
0
R/W
CONF_SE1_OE
Output Enable for CONF_SE1
0=Disabled, 1=Enabled
6
0
R/W
CONF_SE2_OE
Output Enable for CONF_SE2
0=Disabled, 1=Enabled
5
1
R/W
SRC5_CLKREQ#
Output Enable for SRC5
0=Enabled, 1=Disabled
4
1
R/W
SRC4_CLKREQ#
Output Enable for SRC4
0=Enabled, 1=Disabled
3
1
R/W
SRC3_CLKREQ#
Output Enable for SRC3
0=Enabled, 1=Disabled
2
1
R/W
SRC2_CLKREQ#
Output Enable for SRC2
0=Enabled, 1=Disabled
1
R/W
SRC1_CLKREQ#
Output Enable for SRC1
0=Enabled, 1=Disabled
0
1
R/W
SRC_EN
Global Output Enable for SRC[5;1]
0=Disabled, 1=Enabled
Byte 1: Control Register 1
Bit
@Pup
Type
Name
Description
7
0
R/W
REF0_OE
Output Enable for REF0
0=Disabled, 1=Enabled
6
0
R/W
REF1_OE
Output Enable for REF1
0=Disabled, 1=Enabled
5
0
R/W
REF2_OE
Output Enable for REF2
0=Disabled, 1=Enabled
4
1
R/W
SRC5_FREERUN
SRC_EN Control for SRC5
0=Free Running, 1=Stoppable by SRC_EN Pin or Bit
3
1
R/W
SRC4_FREERUN
SRC_EN Control for SRC4
0=Free Running, 1=Stoppable by SRC_EN Pin or Bit
2
1
R/W
SRC3_FREERUN
SRC_EN Control for SRC3
0=Free Running, 1=Stoppable by SRC_EN Pin or Bit
1
R/W
SRC2_FREERUN
SRC_EN Control for SRC2
0=Free Running, 1=Stoppable by SRC_EN Pin or Bit
0
1
R/W
SRC1_FREERUN
SRC_EN Control for SRC1
0=Free Running, 1=Stoppable by SRC_EN Pin or Bit
Byte 2: Control Register 2
Bit
@Pup
Type
Name
Description
7
0
R
Rev Code Bit 3
Revision Code Bit 3
6
0
R
Rev Code Bit 2
Revision Code Bit 2
5
0
R
Rev Code Bit 1
Revision Code Bit 1
4
1
R
Rev Code Bit 0
Revision Code Bit 0
3
1
R
Vendor ID bit 3
Vendor ID Bit 3
2
0
R
Vendor ID bit 2
Vendor ID Bit 2
1
0
R
Vendor ID bit 1
Vendor ID Bit 1
0
R
Vendor ID bit 0
Vendor ID Bit 0
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