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参数资料
| 型号： | SL28PCIE50ALIT |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 2/16页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK PCIE GEN2 48QFN |
| 标准包装： | 2,500 |
| 系列： | EProClock® |
| 类型： | * |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:10 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 100MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
SL28PCIe50
DOC#: SP-AP-0758 (Rev. AA)
Page 10 of 16
JA
Dissipation, Junction to Ambient JEDEC (JESD 51)
–
60
°C/
W
ESDHBM
ESD Protection (Human Body
Model)
JEDEC (JESD 22 - A114)
2000
–
V
UL-94
Flammability Rating
UL (Class)
V–0
Multiple Supplies:
The Voltage on any input or I/O pin cannot exceed the power pin during power-up. Power supply sequencing is NOT required.
DC Electrical Specifications
Parameter
Description
Condition
Min.
Max.
Unit
VDD core
3.3V Operating Voltage
3.3 ± 5%
3.135
3.465
V
VIH
3.3V Input High Voltage (SE)
2.0
VDD + 0.3 V
VIL
3.3V Input Low Voltage (SE)
VSS – 0.3
0.8
V
VIHI2C
Input High Voltage
SDATA, SCLK
2.2
–
V
VILI2C
Input Low Voltage
SDATA, SCLK
–
1.0
V
VIH_CTRL _INPUT Input High Voltage
Applies to all input and latched pins
0.7
VDD+0.3
V
VIL_CTRL _INPUT
Input Low Voltage
Applies to all input and latched pins
VSS – 0.3
0.35
V
IIH
Input High Leakage Current
Except internal pull-down resistors, 0 < VIN <
VDD
–5
A
IIL
Input Low Leakage Current
Except internal pull-up resistors, 0 < VIN < VDD
–5
–
A
VOH
3.3V Output High Voltage (SE) IOH = –1 mA
2.4
–
V
VOL
3.3V Output Low Voltage (SE) IOL = 1 mA
–
0.4
V
IOZ
High-impedance Output
Current
–10
10
A
CIN
Input Pin Capacitance
1.5
5
pF
COUT
Output Pin Capacitance
6
pF
LIN
Pin Inductance
–
7
nH
VXIH
Xin High Voltage
0.7VDD
VDD
V
VXIL
Xin Low Voltage
0
0.3VDD
V
IDD_PWR_DW
Power Down Current
–
1
mA
IDD_3.3V
Dynamic Supply Current
Default Power on, all clock active, CL=0
–
50
mA
IDD_1.05V
Dynamic Supply Current
Default Power on, all clock active, CL=0
–
5
mA
Absolute Maximum Conditions
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参数描述 |
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