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参数资料
| 型号： | SL28PCIE50ALIT |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 13/16页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK PCIE GEN2 48QFN |
| 标准包装： | 2,500 |
| 系列： | EProClock® |
| 类型： | * |
| PLL： | 带旁路 |
| 输入： | 时钟，晶体 |
| 输出： | 时钟 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:10 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 100MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | * |
| 封装/外壳： | * |
| 供应商设备封装： | * |
| 包装： | * |
SL28PCIe50
DOC#: SP-AP-0758 (Rev. AA)
Page 6 of 16
Byte 3: Control Register 3
Bit
@Pup
Type
Name
Description
7
0
R/W
BC7
Byte count register for block read operation. The default value
for Byte count is 8. In order to read more than 8 bytes, the
system needs to change this register to the number of bytes
to be read.
6
0
R/W
BC6
5
0
R/W
BC5
4
0
R/W
BC4
3
1
R/W
BC3
2
0
R/W
BC2
1
0
R/W
BC1
0
R/W
BC0
Byte 4: Control Register 4
Bit
@Pup
Type
Name
Description
7
0
R/W
SRC_AMP1
Amplitude Control for SRC clocks
6
1
R/W
SRC_AMP0
5
0
R/W
CONF_SE1_BIT2
Slew Rate Control for CONF_SE1 and CONF_SE2 clocks
41
R/W
CONF_SE1_BIT1
30
R/W
CONF_SE1_BIT0
20
R/W
CONF_SE2_BIT2
11
R/W
CONF_SE2_BIT1
00
R/W
CONF_SE2_BIT0
By te 4,b it7
By te 4,b it6 A m plitud e
N o te
0
700m V
0
1
800m V
D e fau lt
1
0
900m V
1
1000m V
M ode
BIT2
BIT1
BIT0
Buffe r Str e ngth
000
Str ong
001
Def ault
010
011
100
Wireless Friendly
101
110
111
We ak
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参数描述 |
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