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参数资料
| 型号： | SSTUB32868ET/S |
| 厂商： | NXP SEMICONDUCTORS |
| 元件分类： | 锁存器 |
| 英文描述： | 32868 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA176 |
| 封装： | 6 X 15 MM, 0.70 MM PITCH, LEAD FREE, PLASTIC, MO-246, SOT932-1, TFBGA-176 |
| 文件页数： | 6/30页 |
| 文件大小： | 254K |
| 代理商： | SSTUB32868ET/S |
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SSTUB32868_4
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NXP B.V. 2010. All rights reserved.
Product data sheet
Rev. 04 — 22 April 2010
14 of 30
NXP Semiconductors
SSTUB32868
1.8 V DDR2-800 configurable registered buffer with parity
(1) If the data is clocked in on the m clock pulse, and PAR_IN is clocked in at m + 1, the QERR output signal will be generated on
the m + 2 clock pulse and it will be valid on the m + 3 clock pulse. If an error occurs and the QERR output is driven LOW, it
stays LOW for a minimum of two clock cycles or until RESET is driven LOW.
Fig 7.
Timing diagram during normal operation (RESET = HIGH)
CK
Dn, DODTn,
DCKEn
Qn, QODTn,
QCKEn
tsu
002aab900
CK
mm
+ 1m + 2m + 3m + 4
DCSn
th
tPDM, tPDMSS
CK to Q
PAR_IN
th
tPHL, tPLH
CK to QERR
QERR(1)
output signal is dependent
on the prior unknown event
HIGH or LOW
unknown input event
tsu
CSGEN
RESET
data to QERR latency
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| SSTUB32871AHMLF | 功能描述:IC REGIST BUFF 27BIT DDR2 96-BGA RoHS:是 类别:集成电路 (IC) >> 逻辑 - 专用逻辑 系列:- 产品变化通告:Product Discontinuation 25/Apr/2012 标准包装:1,500 系列:74SSTV 逻辑类型:DDR 的寄存缓冲器 电源电压:2.3 V ~ 2.7 V 位数:14 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:48-TFSOP（0.240"，6.10mm 宽） 供应商设备封装:48-TSSOP 包装:带卷 (TR) |
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