参数资料
型号: ST72F521R6T5
厂商: STMICROELECTRONICS
元件分类: 微控制器/微处理器
英文描述: 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64
封装: 14 X 14 MM, PLASTIC, TQFP-64
文件页数: 103/198页
文件大小: 1267K
代理商: ST72F521R6T5
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ST72521M/R/AR
191/198
ST72521M/(A)R DEVICE CONFIGURATION AND ORDERING INFORMATION (Cont’d)
OPT8 = PLL OFF
PLL activation
This option bit activates the PLL which allows mul-
tiplication by two of the main input clock frequency.
The PLL is guaranteed only with an input frequen-
cy between 2 and 4MHz.
0: PLL x2 enabled
1: PLL x2 disabled
CAUTION: the PLL can be enabled only if the
“OSC RANGE” (OPT11:9) bits are configured to
“MP - 2~4MHz”. Otherwise, the device functionali-
ty is not guaranteed.
OPT7= WDG HALT
Watchdog and HALT mode
This option bit determines if a RESET is generated
when entering HALT mode while the Watchdog is
active.
0: No Reset generation when entering Halt mode
1: Reset generation when entering Halt mode
OPT6= WDG SW
Hardware or software watchdog
This option bit selects the watchdog type.
0: Hardware (watchdog always enabled)
1: Software (watchdog to be enabled by software)
OPT5 = CSS
Clock security system on/off
This option bit enables or disables the clock secu-
rity system function (CSS) which includes the
clock filter and the backup safe oscillator.
0: CSS enabled
1: CSS disabled
When enabled, the selected “OSC RANGE” is
used to determine operating frequency range to
switch to the backup oscillator when the frequency
is out of range.
OPT4:3= VD[1:0]
Voltage detection
These option bits enable the voltage detection
block (LVD, and AVD) with a selected threshold for
the LVD and AVD (EVD+AVD).
Note: For details on the AVD and LVD threshold
levels refer to Section 12.3.2 on page 158
OPT1= PKG80P
80 Pin package selection
This option bit is used to select the package (see
table in PKG44P option bit description).
OPT0= FMP_R
Flash memory read-out protection
This option indicates if the user flash memory is
protected against read-out piracy. This protection
is based on a read and write protection of the
memory in test modes and ICP mode. Erasing the
option bytes when the FMP_R option is selected
causes the whole user memory to be erased first.
0: Read-out protection enabled
1: Read-out protection disabled
Typ. Freq.
Range
OSCRANGE
Compared frequencies
to decide to switch to
the backup oscillator
10
1~2MHz
0
2 x fCPU
fSFOSC
2~4MHz
0
1
fCPU
4~8MHz
1
0
fCPU/2
8~16MHz
1
fCPU/4
Selected Low Voltage Detector
VD1
VD0
LVD and AVD Off
1
Lowest Voltage Threshold (VDD~3.5V)
1
0
Medium Voltage Threshold (VDD~4V)
0
1
Highest Voltage Threshold (VDD~5V)
0
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ST72F521R6TC 功能描述:8位微控制器 -MCU Flask 32K SPI/SCI/I2 RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT
ST72F521R6TCTR 功能描述:8位微控制器 -MCU AUTO 8BIT MICRO RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT