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参数资料
| 型号： | ST92R195C9 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, 24 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | PLASTIC, QFP-80 |
| 文件页数： | 53/208页 |
| 文件大小： | 2312K |
| 代理商： | ST92R195C9 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页当前第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页
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ST92R195C - SYNC CONTROLLER
SYNC CONTROLLER (Cont’d)
SYNC CONTROLLER CONTROL AND STATUS
REGISTER 1 (SCCS1R)
R243 - Read/Write
Register Page: 35
Reset value: 0000 0000 (00h)
Bit 7= EOFVBI:
End Of VBI Flag.
This bit is set to “1” by hardware at the beginning
of the line 25 of the current field, when the End of
VBI interrupt request is sent to the Core. The
EOFVBI flag must be reset by software before the
end of the current field.
Bit 6= FLDST:
Field Start Flag.
This bit is set to “1” by hardware on the leading
edge of the vertical sync pulse when the field start
interrupt request is forwarded to the Core. The
FLDST flag must be reset by software before the
end of the current field.
Bit 5= FLDEV:
Field Even Flag.
This bit is read-only. It indicates which field is cur-
rently running;
0: First field is running
1: Second field is running
Bit 4= HFLG:
Horizontal Sync Flag.
This bit is read-only. It just copies the Horizontal
sync transient information issued by the horizontal
pulse shape unit. The bit is read at “1” at during
each H sync pulse and lasts to “1” up to 4 s.
Bit 3= FSTEN:
Field Start Interrupt Enable.
0: The FLDST interrupt is disabled and the exter-
nal interrupt pin becomes the interrupt input.
1: The FLDST interrupt is enabled and the inter-
rupt from the external pin is disabled.
Bit 2= VBIEN:
VBI Interrupt Enable.
0: The EOFVBI interrupt is disabled and the exter-
nal interrupt pin becomes the interrupt input.
1: The EOFVBI interrupt is enabled and the inter-
rupt from the external pin is disabled.
Bits 1:0= MOD[1:0]
SWAP REGISTER
R255 - Read/Write
Register Page: 0
Reset Value: 00x0 xxxx (xxh)
Bit 7 = VBISEL:
EOFVBI Flag Source Select
The VBISEL bit is used to select the EOFVBI inter-
rupt source either from the deflection sync signals
or from the CVBS sync signals.
0: Deflection lines are used to generate the EOFV-
BI interrupt. Also the default situation, in this
case EOFVBI, is generated at the beginning of
the 25th deflection line in 50 Hz mode and at
the beginning of the 50th deflection line in
100 Hz mode.
1: Selects CVBS as source for EOFVBI genera-
tion. Regardless of the scan rate (50 or
100 Hz), EOFVBI is generated at the beginning
of the 25th CVBS line.
70
EOFVBI FLDST FLDEV HFLG FSTEN VBIEN MOD1 MOD0
MOD1 MOD0 H & V sync
sources
CSO
CSO generator
00
chassis
sync pulses
no
-
0
1
reserved
10
from Xtal
(60 Hz)
yes
on-chip timing genera-
tor; free-running
11
from Xtal
(50 Hz)
yes
on-chip timing genera-
tor; free-running
70
VBISEL
xx
xxx
xx
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PDF描述 |
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参数描述 |
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| ST92T163R4T1 | 功能描述:8位微控制器 -MCU OTP EPROM 20K USB/I2 RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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