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参数资料
| 型号： | STM32W108HBU7 |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, QCC40 |
| 封装： | 6 X 6 MM, 0.50 MM PITCH, ROHS COMPLIANT, VFQFPN-40 |
| 文件页数： | 74/198页 |
| 文件大小： | 2871K |
| 代理商： | STM32W108HBU7 |
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STM32W108CB, STM32W108HB
Interrupts
Doc ID 16252 Rev 3
165/198
12.1.2
Faults
Four of the exceptions in the NVIC are faults: Hard Fault, Memory Fault, Bus Fault, and
Usage Fault. Of these four, three of the faults (Hard Fault, Memory Fault, and Usage Fault)
are all standard ARM Cortex-M3 exceptions.
The Bus Fault, though, is derived from STM32W108-specific sources. The Bus Fault
sources are recorded in the SCS_AFSR register. Note that it is possible for one access to
set multiple SCS_AFSR bits. Also note that MPU configurations could prevent most of these
bus fault accesses from occurring, with the advantage that illegal writes are made precise
faults. The four bus faults are:
●
WRONGSIZE - Generated by an 8-bit or 16-bit read or write of an APB peripheral
register. This fault can also result from an unaligned 32-bit access.
●
PROTECTED - Generated by a user mode (unprivileged) write to a system APB or
AHB peripheral or protected RAM.
●
RESERVED - Generated by a read or write to an address within an APB peripheral's 4
kB block range, but the address is above the last physical register in that block range.
Also generated by a read or write to an address above the top of RAM or flash.
●
MISSED - Generated by a second SCS_AFSR fault. In practice, this bit is not seen
since a second fault also generates a hard fault, and the hard fault preempts the bus
fault.
12.2
Event manager
While the standard ARM Cortex-M3 Nested Vectored Interrupt Controller provides top-
level interrupts into the CPU, the Event Manager provides second-level interrupts. The
Event Manager takes a large variety of hardware interrupt sources from the peripherals and
merges them into a smaller group of interrupts in the NVIC. Effectively, all second-level
interrupts from a peripheral are "ORed" together into a single interrupt in the NVIC. In
addition, the Event Manager provides missed indicators for the top-level peripheral
interrupts with the register INT_MISS.
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相关代理商/技术参数 |
参数描述 |
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