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参数资料
型号： TMP86CH72FG
厂商： Toshiba Corporation
英文描述： Zener Diode; Application: General; Pd (mW): 500; Vz (V): 19.5 to 20.4; Condition Iz at Vz (mA): 2; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35
中文描述： 8位微控制器
文件页数： 108/198页
文件大小： 1821K
代理商： TMP86CH72FG
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Page 98
11. 8-Bit TimerCounter 4 (TC4)
11.1 Configuration
TMP86CH72FG
11.2 TimerCounter Control
The TimerCounter 4 is controlled by the TimerCounter 4 control register (TC4CR) and timer registers 4 (TC4DR).
Note 1: fc: High-frequency clock [Hz], fs: Low-frequency clock [Hz],
*
: Don’t care
Note 2: To set the timer registers, the following relationship must be satisfied.
1
≤
TC4DR
≤
255
Note 3: To start timer operation (TC4S = 0
→
1) or disable timer operation (TC4S = 1
→
0), do not change the
TC4CR<TC4M, TC4CK> setting. During timer operation (TC4S = 1
→
1), do not change it, either. If the setting is
programmed during timer operation, counting is not performed correctly.
Note 4: The event counter and PWM output modes are used only in the NOMAL1/2 and IDLE1/2 modes.
Note 5: When the STOP mode is entered, the start control (TC4S) is cleared to “0” automatically.
Note 6: The bit 6 and 7 of TC4CR are read as a don’t care when these bits are read.
Note 7: In the timer, event counter and PDO modes, do not change the TC4DR setting when the timer is running.
Note 8: When the high-frequency clock fc exceeds 10 MHz, do not select the source clock of TC4CK = 110.
Note 9: The operating clock fs can not be used in NORMAL1 or IDEL1 mode (when low-frequency oscillation is stopped.)
Note 10:For available source clocks depending on the operation mode, refer to the following table.
Note:
O
: Available source clock
Timer Register and Control Register
TC4DR
(0018)
7
6
5
4
3
2
1
0
Read/Write (Initial value: 1111 1111)
TC4CR
(0014)
7
6
5
4
3
2
1
0
TC4S
TC4CK
TC4M
Read/Write (Initial value: **00 0000)
TC4S
TC4 start control
0: Stop and counter clear
1: Start
R/W
TC4CK
TC4 source clock select
[Hz]
NORMAL1/2, IDLE1/2 mode
Divider
SLOW1/2,
SLEEP1/2
mode
R/W
DV7CK
=
0
DV7CK
=
1
000
fc/2
11
fs/2
3
DV9
fs/2
3
001
fc/2
7
fc/2
7
DV5
–
010
fc/2
5
fc/2
5
DV3
–
011
fc/2
3
fc/2
3
DV1
–
100
fc/2
2
fc/2
2
–
–
101
fc/2
fc/2
–
–
110
fc
fc
–
–
111
External clock (TC4 pin input)
TC4M
TC4 operating mode
select
00: Timer/event counter mode
01: Reserved
10: Programmable divider output (PDO) mode
11: Pulse width modulation (PWM) output mode
R/W
TC4CK
Timer Mode
Event Counter Mode
PDO Mode
PWM Mode
000
O
O
001
O
O
010
O
O
011
O
O
100
O
101
O
110
O
111
O
×
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PDF描述
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