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参数资料
| 型号： | TMP86CH72FG |
| 厂商： | Toshiba Corporation |
| 英文描述： | Zener Diode; Application: General; Pd (mW): 500; Vz (V): 19.5 to 20.4; Condition Iz at Vz (mA): 2; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35 |
| 中文描述： | 8位微控制器 |
| 文件页数： | 176/198页 |
| 文件大小： | 1821K |
| 代理商： | TMP86CH72FG |
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Page 166
17. Vacuum Fluorescent Tube (VFT) Driver Circuit
17.2 Configuration
TMP86CH72FG
17.3.1 Setting of Display mode
VFT display mode is set by VFT control register 1 (VFTCR1), VFT control register 2 (VFTCR2) and VFT
control register 3 (VFTCR3). VFT control register 1 (VFTCR1) sets 1 display time (tdisp) and the number of
display lines (VSEL), VFT control register 2 (VFTCR2) sets dimmer timer (DIM) and state (STA) and VFT
control register 3 (VFTCR3) sets Port Tr mode (HVTR0/1). (BLK of VFTCR1 must be set to “1”.) The seg-
ments and the digits are not fixed, so that they can be freely allocated. However the number of states must be
specified according to the number of digits of VFT which you use. Thought the layout of VFT display mode is
freely allocated, the followings are recommended; usually, large current output (V0 to V15) is used for a digit,
and middle current output (V16 to V31) is used for a segment.
In case of changeing the setting of dimmer time (DIM) in display-on, it is available to change whenever the
BLK status is "0".
17.3.2 Display data setting
Data are converted into VFT display data by instructions. The converted data stored in the display data buffer
(addresses 0F80H to 0FBFH in DBR) are automatically transferred to the VFT driver circuit (V0 to V31), then
transferred to the high-breakdown voltage output buffer. Thus, to change the display pattern, just change the
data in the display data buffer.
Bits in the VFT segment (dot) and display data area correspond one to one. When data are set to 1, the seg-
ments corresponding to the bits light. The display data buffer is assigned to the DBR area shown in Figure 17-
2. (The display data buffer can not be used as data memory)
Figure 17-2 VFT Display Data Buffer Memory (DBR)
Note: Contents in data memory is cleared ( unknown data ) after power-on.
0F80
0
7
V0
V7
Bit
Timing
Output pin
0F81
0F82
0F83
0F84
0F85
0F86
0F87
0F88
0F89
0F8A
0F8B
0F8C
0F8D
0F8E
0F8F
0F90
0
7
V8
V15
0F91
0F92
0F93
0F94
0F95
0F96
0F97
0F98
0F99
0F9A
0F9B
0F9C
0F9D
0F9E
0F9F
0FA0
0
7
V16
V23
0FA1
0FA2
0FA3
0FA4
0FA5
0FA6
0FA7
0FA8
0FA9
0FAA
0FAB
0FAC
0FAD
0FAE
0FAF
0FB0
0
7
V24
V31
0FB1
0FB2
0FB3
0FB4
0FB5
0FB6
0FB7
0FB8
0FB9
0FBA
0FBB
0FBC
0FBD
0FBE
0FBF
T0
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PDF描述 |
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