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参数资料
| 型号： | TMP86CH72FG |
| 厂商： | Toshiba Corporation |
| 英文描述： | Zener Diode; Application: General; Pd (mW): 500; Vz (V): 19.5 to 20.4; Condition Iz at Vz (mA): 2; C (pF) max: -; Condition VR at C (V):   ESD (kV) min: -; Package: DO-35 |
| 中文描述： | 8位微控制器 |
| 文件页数： | 152/198页 |
| 文件大小： | 1821K |
| 代理商： | TMP86CH72FG |
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Page 142
14. Serial Bus Interface(I2C Bus) Ver.-D (SBI)
14.5 I2C Bus Control
TMP86CH72FG
When a stop condition on the bus or an arbitration lost is detected, the TRX is cleared to “0” by the hardware.
" Table 14-2 TRX changing conditions in each mode " shows TRX changing conditions in each mode and TRX
value after changing
When a serial bus interface circuit operates in the free data format, a slave address and a direction bit are not
recognized. They are handled as data just after generating a start condition. The TRX is not changed by a hard-
ware.
14.5.7 Start/stop condition generation
When the BB (Bit5 in SBISRB) is “0”, a slave address and a direction bit which are set to the SBIDBR are
output on a bus after generating a start condition by writing “1” to the MST, TRX, BB and PIN. It is necessary
to set ACK to “1” beforehand.
Figure 14-5 Start Condition Generation and Slave Address Generation
When the BB is “1”, sequence of generating a stop condition is started by writing “1” to the MST, TRX and
PIN, and “0” to the BB. Do not modify the contents of MST, TRX, BB and PIN until a stop condition is gener-
ated on a bus.
When a stop condition is generated and the SCL line on a bus is pulled-down to low level by another device,
a stop condition is generated after releasing the SCL line.
Figure 14-6 Stop Condition Generation
The bus condition can be indicated by reading the contents of the BB (Bit5 in SBISRB). The BB is set to “1”
when a start condition on a bus is detected (Bus Busy State) and is cleared to “0” when a stop condition is
detected (Bus Free State).
14.5.8 Interrupt service request and cancel
When a serial bus interface circuit is in the master mode and transferring a number of clocks set by the BC
and the ACK is complete, a serial bus interface interrupt request (INTSBI) is generated.
Table 14-2 TRX changing conditions in each mode
Mode
Direction Bit
Conditions
TRX after Changing
Slave
Mode
"0"
A received slave address is
the same value set to I2CAR
"0"
"1"
"1"
Master
Mode
"0"
ACK signal is returned
"1"
"1"
"0"
Slave address and the direction bit
Start condition
Acknowledge signal
A6
A5
2
3
4
5
6
7
8
9
A4
A3
A2
A1
A0
R/W
1
SCL pin
SDA pin
Stop condition
SCL pin
SDA pin
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PDF描述 |
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