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参数资料
| 型号： | TMP91FW60FG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-44 |
| 文件页数： | 168/322页 |
| 文件大小： | 4595K |
| 代理商： | TMP91FW60FG |
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2007-10-15
TMP91FW60
(2)How to release the HALT mode
These halt states can be released by resetting or requesting an interrupt. The halt release sources are
determined by the combination between the states of interrupt mask register <IFF2:0> and the HALT
modes. The details for releasing the halt status are shown in Table 2-7.
Released by requesting an interrupt
The operating released from the HALT mode depends on the interrupt enabled status. When the inter-
rupt request level set before executing the HALT instruction exceeds the value of interrupt mask register,
the interrupt due to the source is processed after releasing the HALT mode, and CPU status executing an
instruction that follows the HALT instruction. When the interrupt request level set before executing the
HALT instruction is less than the value of the interrupt mask register, releasing the HALT mode is not
executed. (In non-maskable interrupts, interrupt processing is processed after releasing the HALT mode
regardless of the value of the mask register.) However only for INT0 and RTC interrupts, even if the inter-
rupt request level set before executing the HALT instruction is less than the value of the interrupt mask
register, releasing the HALT mode is executed. In this case, interrupt processing, and CPU starts execut-
ing the instruction next to the HALT instruction, but the interrupt request flag is held at "1".
Note:Usually, interrupts can release all halts status. However, the interrupts (NMI, INT0, INTRTC) which can release
the HALT mode may not be able to do so if they are input during the period CPU is shifting to the HALT mode
(for about 5 clocks of fFPH) with IDLE1 or STOP mode (IDLE2 is not applicable to this case). (In this case, an
interrupt request is kept on hold internally.) If another interrupt is generated after it has shifted to HALT mode
completely, halt status can be released without difficulty. The priority of this interrupt is compared with that of
the interrupt kept on hold internally, and the interrupt with higher priority is handled first followed by the other
interrupt.
Releasing by resetting
Releasing all halt status is executed by resetting.
When the STOP mode is released by RESET, it is necessary enough resetting time (See Table 2-6)to set
the operation of the oscillator to be stable.
When releasing the HALT mode by resetting, the internal RAM data keeps the state before the "HALT"
instruction is executed. However the other settings contents are initialized. (Releasing due to interrupts keeps
the state before the "HALT" instruction is executed.)
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参数描述 |
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