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参数资料
型号： TMP91FW60FG
元件分类： 微控制器/微处理器
英文描述： MICROCONTROLLER, PQFP100
封装： 14 X 14 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-44
文件页数： 47/322页
文件大小： 4595K
代理商： TMP91FW60FG
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Page 136
2007-10-15
TMP91FW60
Example: To output a 2-ms one-shot pulse with a 3-ms delay to the external trigger pulse to the TB0IN0
pin.
Note: X: Don't care, –: No change
When delay time is unnecessary, invert timer flip-flop TB0FF0 when up-counter value is loaded into
capture register (TB0CP0H/L), and set the TB0CP0H/L value (c) plus the one-shot pulse width (p) to
TB0RG1H/L when the interrupt INT5 occurs. The TB0FF0 inversion should be enable when the up
counter (UC10) value matches TB0RG1H/L, and disabled when generating the interrupt INTTB01.
Figure 7-6
One-shot Pulse Output (without delay)
* Clock state
System clock:
High frequency (fc)
Clock gear:
1 (fc)
Prescaler clock:
fFPH
TB0MOD
←
X
1
0100
1
Set free running. Count with
φT1. Load the up counter value into
TB0CP0H/L at the rising edge of TB0IN0 pin input.
TB0FFCR
←
X
0
0001
0
Clear TB0FF0 to 0. Disable inversion of TB0FF0.
P8CR
←
–––
––1–
–
Set P82 to function as the TB0OUT0 pin.
Set P80 to TB0IN0 input mode.
P8FC
←
–––
––1–
–
INTE56
←
X
–
X
1
0
Enable INT5.
INTETB0
←
X
0
X
0
Disable INTTB00 and INTTB01.
TB0RUN
←
–0
X
–1
X
1
Start TMRB0.
TB0RG0
←
TB0CP0
+ 3 ms/φT1
TB0RG1
←
TB0RG0
+ 2 ms/φT1
TB0FFCR
←
X
–
–11–
–
Enable TB0FF0 inversion when the up counter value match with
TB0RG0H/L or TB0RG1H/L.
INTETB0
←
X
1
0
X
–
Enable INTTB01.
TB0FFCR
←
X
–
–00–
–
Disable inversion of TB0FF0 when the up counter value match with
value of TB0RG0H/L or TB0RG1H/L.
INTETB0
←
X
0
X
–
Disable INTTB01.
c
p
c
+ p
Count clock
(Prescaler output clock)
Timer output
TB0OUT0
TB0IN0 pin input
(External trigger pulse)
Match with TB0RG1H/L
Inversion enable
INTTB01
occurred.
Enables inversion caused by loading
into TB0CP0H/L.
Load into capture register 0 (TB0CP0H/L).
INT5 occurred.
Load the up counter value in
capture register 1 (TB0CP1
Disable inversion caused by loading
into TB0CP1H/L.
Pulse width
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PDF描述
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