参数资料
型号: TMP91FW60FG
元件分类: 微控制器/微处理器
英文描述: MICROCONTROLLER, PQFP100
封装: 14 X 14 MM, 0.50 MM PITCH, LEAD FREE, PLASTIC, LQFP-44
文件页数: 3/322页
文件大小: 4595K
代理商: TMP91FW60FG
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Page 96
2007-10-15
TMP91FW60
5.2.4
Bus width and wait control for an area other than CS0 to CS3
The chip select/wait control register BEXCS controls the bus width and number of waits when memory loca-
tions which are not in one of the four user-specified address areas (CS0 to CS3) are accessed. The BEXCS reg-
ister settings are always enabled for areas other than CS0 to CS3.
5.2.5
Selecting 16-Mbyte area/specified address area
Setting B2CS<B2M> (Bit6 of the chip select/wait control register for CS2) to “0” designates the 16-Mbyte
area “002000 to FDFFFF” as the CS2 area. Setting B2CS<B2M> to “1” designates the address area specified
by the start address register MSAR2 and the address mask register MAMR2 as CS2 (e.g., if B2CS<B2M> = 1,
CS2 is specified in the same manner as CS0, CS1 and CS3 are).
A reset clears this bit to “0”, specifying CS2 as a 16-Mbyte address area.
5.2.6
Procedure for setting chip select/wait control
When using the chip select/wait control function, set the registers in the following order:
1. Set the memory start address registers MSAR0 to MSAR3.
Set the start addresses for CS0 to CS3.
2. Set the memory address mask registers MAMR0 to MAMR3.
Set the sizes of CS0 to CS3.
3. Set the chip select/wait control registers B0CS to B3CS.
Set the chip select output waveform, data bus width, number of waits and master enable/disable status for
CS0
to CS3.
The CS0 to CS3 pins can also function as pins P40 to P43. To output a chip select signal using one of these
pins, set the corresponding bit in the port 6 function register P4FC/P4FC2 to “1”.
If a CS0 to CS3 address is specified which is actually an internal I/O and RAM area address, the CPU
accesses the internal address area and no chip select signal is output on any of the CS0 to CS3 pins.
Example :In this example CS0 is set to the 64-Kbyte area 010000H to 01FFFFH. The bus width is set to 16 bits and the
number of waits is set to 0.
LD
(MSAR0), 01H
; Start address: 010000H
LD
(MAMR0), 07H
; Address area: 64 Kbytes
LD
(B0CS), 83H
; ROM/SRAM, 16-bit data bus, 0 waits, CS0 area settings enabled
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