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参数资料
型号： UPD70F3747GB-GAH-AX
厂商： Renesas Electronics America
文件页数： 21/191页
文件大小： 0K
描述： MCU 32BIT V850ES/HX3 64-LQFP
标准包装： 300
系列： V850ES/Hx3
核心处理器： V850ES
芯体尺寸： 32-位
速度： 32MHz
连通性： CSI，I²C，UART/USART
外围设备： DMA，LVD，PWM，WDT
输入/输出数： 51
程序存储器容量： 128KB（128K x 8）
程序存储器类型： 闪存
RAM 容量： 8K x 8
电压 - 电源 (Vcc/Vdd)： 3.7 V ~ 5.5 V
数据转换器： A/D 10x10b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 64-LQFP
包装： 托盘
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2009-2011 Microchip Technology Inc.
DS61156G-page 155
PIC32MX5XX/6XX/7XX
23.0 CONTROLLER AREA
NETWORK (CAN)
The Controller Area Network (CAN) module supports
the following key features:
Standards Compliance:
- Full CAN 2.0B compliance
- Programmable bit rate up to 1 Mbps
Message Reception and Transmission:
- 32 message FIFOs
- Each FIFO can have up to 32 messages for a
total of 1024 messages
- FIFO can be a transmit message FIFO or a
receive message FIFO
- User-defined priority levels for message
FIFOs used for transmission
- 32 acceptance filters for message filtering
- Four acceptance filter mask registers for
message filtering
- Automatic response to remote transmit request
- DeviceNet addressing support
Additional Features:
- Loopback, Listen All Messages and Listen
Only modes for self-test, system diagnostics
and bus monitoring
- Low-power operating modes
- CAN module is a bus master on the PIC32
system bus
- Use of DMA is not required
- Dedicated time-stamp timer
- Dedicated DMA channels
- Data-only Message Reception mode
Figure 23-1 illustrates the general structure of the CAN
module.
FIGURE 23-1:
PIC32 CAN MODULE BLOCK DIAGRAM
Note 1:
This data sheet summarizes the features
of the PIC32MX5XX/6XX/7XX family of
devices. It is not intended to be a
comprehensive reference source. To
complement the information in this data
sheet, refer to Section 34. “Controller
Area Network (CAN)”
(DS61154) in the
“PIC32 Family Reference Manual”
, which
is available from the Microchip web site
(www.microchip.com/PIC32).
2:
Some registers and associated bits
described in this section may not be
available on all devices. Refer to
Section 4.0 “Memory Organization”
in
this data sheet for device-specific register
and bit information.
Message Buffer 31
Message Buffer 1
Message Buffer 0
Message Buffer 31
Message Buffer 1
Message Buffer 0
Message Buffer 31
Message Buffer 1
Message Buffer 0
FIFO0
FIFO1
FIFO31
System RAM
Up
to
32
Messa
ge
Buf
fers
CAN Message FIFO (up to 32 FIFOs)
Message
Buffer Size
2 or 4 Words
System Bus
CPU
CAN Module
32 Filters
4 Masks
CxTX
CxRX
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PDF描述
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