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参数资料
型号： UPD78F1235GK-GAJ-AX
厂商： Renesas Electronics America
文件页数： 420/1067页
文件大小： 0K
描述： MCU 16BIT 78K0R/LX3 64-LQFP
标准包装： 300
系列： 78K0R/Ix3
核心处理器： 78K/0R
芯体尺寸： 16-位
速度： 40MHz
连通性： 3 线 SIO，I²C，LIN，UART/USART
外围设备： DMA，LVD，POR，PWM，WDT
输入/输出数： 50
程序存储器容量： 64KB（64K x 8）
程序存储器类型： 闪存
RAM 容量： 3K x 8
电压 - 电源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
数据转换器： A/D 12x10b
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 64-LQFP
包装： 托盘
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CHAPTER 7 INVERTER CONTROL FUNCTIONS
User’s Manual U19678EJ1V1UD
413
7.5.5 Operation as triangular wave PWM output function with dead time
The triangular wave modulation PWM output function with dead time uses four channels of channels 0 to 3 or
channels 4 to 7 in combination to output a triangular wave PWM waveform (with dead time).
It outputs riangular wave modulation PWM with dead times from slave channels 2 and 3, and slave channels 6 and
7. Slave channels 1 and 5 can be operated in any operation mode.
The output pulse cycle, positive-phase active width, and reverse-phase active width can be calculated by using the
following equations.
Pulse period (down/up) = {Set value of TDRn (master) + 1}
× 2 × Count clock period
positive-phase active width = {{{Set value of TDRn (master) + 1}
{Set value of TDRp (slave p) }} × 2
{Set value of TDRq (slave q) + 1}}
× Count clock period
reverse-phase active width = {{{Set value of TDRn (master) + 1}
{Set value of TDRp (slave p) }} × 2 +
{Set value of TDRq (slave q) + 1}}
× Count clock period
Errors will be included in the output waveforms when the dead time function is used.
The output width of a
positive-phase wave will be shortened by the amount of dead time, and the output width of a reverse- phase wave will
be extended by the amount of dead time. The linearity of output transition will be lost in the neighborhood of 0% and
100% outputs due to the errors.
0% output: Set value of TDRp (slave p)
≥ Set value of TDRn (master) + 1
100% output: Set value of TDRp (slave p) = 0000H
At the master channel, channels 0 and 4 are used.
TCRn operates as a down counter in the interval timer mode.
TCRn loads the value of TDRn at the first count clock, after the channel start trigger bit (TSn) is set to 1.
Afterward, TCRn counts down along with the count clock.
When TCRn has become 0000H, INTTMn is output and TOn is toggled upon the next count clock. TCRn loads the
value of TDRn again at the same timing. Similar operation is continued hereafter.
A carrier period is generated in two periods of the master channel count.
The count operation of the slave channel is controlled by defining the first period of the master channel as a down
status of the slave channel and the second period as an up status of the slave channel.
TOn of the master channel outputs up and down statuses.
TOn of the TO0 register must be manipulated while TOEn of the TOE0 register is 0 and the default level must be
set, because up and down statuses are output.
TOn of the TO0 register is set to 1 when MDn0 of the TMRn register is 0, and TOn is set to 0 when MDn0 is 1.
By setting the default level, a high level is output from TO00 during a down status and a low level is output during
an up status.
Remark
n = 00, 04
p = 02, 06
q = 03, 07
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PDF描述
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相关代理商/技术参数
参数描述
UPD78F1500AGC-GAD-AX 制造商:Renesas Electronics Corporation 功能描述:16BIT, 78K0R/LX3, 80PIN, P-LQFP - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 16BIT 64KB FLASH 64LQFP
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UPD78F1500GK-GAK-AX 制造商:Renesas Electronics Corporation 功能描述:
UPD78F1501AGC-GAD-AX 制造商:Renesas Electronics Corporation 功能描述:16BIT, 78K0R/LX3, 80PIN, P-LQFP - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 16BIT 96KB FLASH 80LQFP
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