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参数资料
| 型号： | W9864G6IH-6A |
| 厂商： | WINBOND ELECTRONICS CORP |
| 元件分类： | DRAM |
| 英文描述： | 4M X 16 SYNCHRONOUS DRAM, 5 ns, PDSO54 |
| 封装： | 0.400 INCH, ROHS COMPLIANT, TSOP2-54 |
| 文件页数： | 33/44页 |
| 文件大小： | 666K |
| 代理商： | W9864G6IH-6A |
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W9864G6IH
Publication Release Date: Mar. 22, 2010
- 39 -
Revision A11
11.19 Timing Chart of Burst Stop Cycle (Burst Stop Command)
Read
BST
0
11
10
9
8
7
6
5
4
3
2
1
DQ
Q0
Q1
Q2
Q3
BST
( a ) CAS latency =2
Command
( b )CAS latency = 3
(1) Read cycle
Q4
(2) Write cycle
Command
Read
Command
Q0
Q1
Q2
Q3
Q4
Q0
Q1
Q2
Q3
Q4
DQ
Write
BST
Note:
represents the Burst stop command
BST
11.20 Timing Chart of Burst Stop Cycle (Precharge Command)
01
11
10
9
8
7
6
5
4
3
2
(1 ) R e ad cy cle
(a ) C A S la te n c y = 2
C o m m a n d
Q0
Q1
Q2
Q3
Q4
P RCG
Re a d
(b ) C A S la te n c y = 3
C o m m a n d
Q0
Q1
Q2
Q3
Q4
P RCG
Re a d
DQ
(2 ) W r ite c ycle
Co m m a n d
Q0
Q1
Q2
Q3
Q4
P RCG
Write
DQ
DQ M
tW R
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