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参数资料
| 型号： | WJLXT384LEB1 |
| 厂商： | INTEL CORP |
| 元件分类： | 数字传输电路 |
| 英文描述： | DATACOM, PCM TRANSCEIVER, PQFP144 |
| 封装： | 20 X 20MM, ROHS COMPLIANT, LQFP-144 |
| 文件页数： | 117/140页 |
| 文件大小： | 1514K |
| 代理商： | WJLXT384LEB1 |
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78
Document Number: 248994
Revision Number: 005
Revision Date: November 28, 2005
Intel LXT384 Octal T1/E1/J1 S/H PCM Transceiver with JA
8.3
Register Descriptions
Table 28. ID Register, ID - 00h
Bit
Name
Description
R/W
7:0
ID7:0
Identification.
The identification register contains a unique revision code that is factory
programmed for each revision of the LXT384 Transceiver.
Revision code for the LXT384 Transceiver stepping A4 is 00h.
Revision code for the LXT384 Transceiver stepping A5 is 15h.
R
Table 29. Analog Loopback Register, ALOOP - 01h
Bit
Name
Description
R/W
7:0
AL7:0
Analog Loopback.
Setting one of the AL bits to ‘1’ enables analog loopback for its corresponding
transceiver.
R/W
Table 30. Remote Loopback Register, RLOOP - 02h
Bit
Name
Description
R/W
7:0
RL7:0
Remote Loopback.
Setting one of the RL bits to ‘1’ enables remote loopback for its corresponding
transceiver.
R/W
Table 31. TAOS Enable Register, TAOS - 03h
Bit
Name
Description
R/W
7:0
TAOS7:0
Transmit All Ones (Enable).
On power-up, the TAOS7:0 bits are cleared to ‘0’.
Setting one of the TAOS bits to ‘1’ causes a continuous stream of marks
(that is, ones) to be sent out to the TTIP pin and TRING pin of the
corresponding transmitter.
There are two possible timing references for these bits, depending on the
availability of MCLK. If MCLK:
Is not available, then the channel TCLK is used as the timing reference
for the output.
Is available, MCLK is used as the timing reference for the output.
NOTE: TAOS is not available in data-recovery mode or the line-driver mode
(that is, when both MCLK = High and TCLK = High).
R/W
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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