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参数资料
型号： XA3SD1800A-4CSG484Q
厂商： Xilinx Inc
文件页数： 15/58页
文件大小： 0K
描述： SPARTAN-3ADSP FPGA 1800K 484CSBG
产品培训模块： Extended Spartan 3A FPGA Family
标准包装： 84
系列： Spartan®-3A DSP XA
LAB/CLB数： 4160
逻辑元件/单元数： 37440
RAM 位总计： 1548288
输入/输出数： 309
门数： 1800000
电源电压： 1.14 V ~ 1.26 V
安装类型： 表面贴装
工作温度： -40°C ~ 125°C
封装/外壳： 484-FBGA，CSPBGA
供应商设备封装： 484-CSPBGA
配用： 122-1574-ND - KIT DEVELOPMENT SPARTAN 3ADSP
XA Spartan-3A DSP Automotive FPGA Family Data Sheet
DS705 (v2.0) April 18, 2011
www.xilinx.com
Product Specification
22
HSTL_I
0.72
ns
HSTL_III
0.85
ns
HSTL_I_18
0.69
ns
HSTL_II_18
0.83
ns
HSTL_III_18
0.79
ns
SSTL18_I
0.71
ns
SSTL18_II
0.71
ns
SSTL2_I
0.71
ns
SSTL2_II
0.71
ns
SSTL3_I
0.78
ns
SSTL3_II
0.78
ns
Differential Standards
LVDS_25
0.79
ns
LVDS_33
0.79
ns
BLVDS_25
0.79
ns
MINI_LVDS_25
0.84
ns
MINI_LVDS_33
0.84
ns
LVPECL_25
0.80
ns
LVPECL_33
0.80
ns
RSDS_25
0.83
ns
RSDS_33
0.83
ns
TMDS_33
0.80
ns
PPDS_25
0.81
ns
PPDS_33
0.81
ns
DIFF_HSTL_I_18
0.80
ns
DIFF_HSTL_II_18
0.98
ns
DIFF_HSTL_III_18
1.05
ns
DIFF_HSTL_I
0.77
ns
DIFF_HSTL_III
1.05
ns
DIFF_SSTL18_I
0.76
ns
DIFF_SSTL18_II
0.76
ns
DIFF_SSTL2_I
0.77
ns
DIFF_SSTL2_II
0.77
ns
DIFF_SSTL3_I
1.06
ns
DIFF_SSTL3_II
1.06
ns
Notes:
1.
The numbers in this table are tested using the methodology presented in Table 27 and are based on
the operating conditions set forth in Table 8, Table 11, and Table 13.
2.
These adjustments are used to convert input path times originally specified for the LVCMOS25
standard to times that correspond to other signal standards.
Table 23: Input Timing Adjustments by IOSTANDARD (Cont’d)
Convert Input Time from LVCMOS25 to the
Following Signal Standard (IOSTANDARD)
Add the Adjustment Below
Units
Speed Grade: -4
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