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参数资料
| 型号： | XC2S50-5FGG256C |
| 厂商： | Xilinx Inc |
| 文件页数： | 61/99页 |
| 文件大小： | 0K |
| 描述： | IC SPARTAN-II FPGA 50K 256-FBGA |
| 标准包装： | 90 |
| 系列： | Spartan®-II |
| LAB/CLB数： | 384 |
| 逻辑元件/单元数： | 1728 |
| RAM 位总计： | 32768 |
| 输入/输出数： | 176 |
| 门数： | 50000 |
| 电源电压： | 2.375 V ~ 2.625 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 256-BGA |
| 供应商设备封装： | 256-FBGA（17x17） |
| 产品目录页面： | 599 (CN2011-ZH PDF) |
| 其它名称： | 122-1319 |
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Spartan-II FPGA Family: DC and Switching Characteristics
DS001-3 (v2.8) June 13, 2008
Module 3 of 4
Product Specification
64
R
CLB Switching Characteristics
Delays originating at F/G inputs vary slightly according to the input used. The values listed below are worst-case. Precise
values are provided by the timing analyzer.
Symbol
Description
Speed Grade
Units
-6
-5
Min
Max
Min
Max
Combinatorial Delays
TILO
4-input function: F/G inputs to X/Y outputs
-
0.6
-
0.7
ns
TIF5
5-input function: F/G inputs to F5 output
-
0.7
-
0.9
ns
TIF5X
5-input function: F/G inputs to X output
-
0.9
-
1.1
ns
TIF6Y
6-input function: F/G inputs to Y output via F6 MUX
-
1.0
-
1.1
ns
TF5INY
6-input function: F5IN input to Y output
-
0.4
-
0.4
ns
TIFNCTL
Incremental delay routing through transparent latch
to XQ/YQ outputs
-
0.7
-
0.9
ns
TBYYB
BY input to YB output
-
0.6
-
0.7
ns
Sequential Delays
TCKO
FF clock CLK to XQ/YQ outputs
-
1.1
-
1.3
ns
TCKLO
Latch clock CLK to XQ/YQ outputs
-
1.2
-
1.5
ns
Setup/Hold Times with Respect to Clock CLK(1)
TICK / TCKI
4-input function: F/G inputs
1.3 / 0
-
1.4 / 0
-
ns
TIF5CK / TCKIF5
5-input function: F/G inputs
1.6 / 0
-
1.8 / 0
-
ns
TF5INCK / TCKF5IN
6-input function: F5IN input
1.0 / 0
-
1.1 / 0
-
ns
TIF6CK / TCKIF6
6-input function: F/G inputs via F6 MUX
1.6 / 0
-
1.8 / 0
-
ns
TDICK / TCKDI
BX/BY inputs
0.8 / 0
-
0.8 / 0
-
ns
TCECK / TCKCE
CE input
0.9 / 0
-
0.9 / 0
-
ns
TRCK / TCKR
SR/BY inputs (synchronous)
0.8 / 0
-
0.8 / 0
-
ns
Clock CLK
TCH
Minimum pulse width, High
-
1.9
-
1.9
ns
TCL
Minimum pulse width, Low
-
1.9
-
1.9
ns
Set/Reset
TRPW
Minimum pulse width, SR/BY inputs
3.1
-
3.1
-
ns
TRQ
Delay from SR/BY inputs to XQ/YQ outputs
(asynchronous)
-
1.1
-
1.3
ns
TIOGSRQ
Delay from GSR to XQ/YQ outputs
-
9.9
-
11.7
ns
FTOG
Toggle frequency (for export control)
-
263
-
263
MHz
Notes:
1.
A zero hold time listing indicates no hold time or a negative hold time.
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PDF描述 |
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