参数资料
| 型号： | XC3090L-8PC84C |
| 厂商： | Xilinx Inc |
| 文件页数： | 55/76页 |
| 文件大小： | 0K |
| 描述： | IC FPGA 3.3V C-TEMP 84-PLCC |
| 产品变化通告： | XC3000(L) Discontinuation 01/Feb/2003 |
| 标准包装： | 15 |
| 系列： | XC3000A/L |
| LAB/CLB数： | 320 |
| RAM 位总计： | 64160 |
| 输入/输出数： | 70 |
| 门数： | 6000 |
| 电源电压： | 3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 85°C |
| 封装/外壳： | 84-LCC（J 形引线） |
| 供应商设备封装： | 84-PLCC |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页当前第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页
R
November 9, 1998 (Version 3.1)
7-61
XC3000 Series Field Programmable Gate Arrays
7
XC3100L CLB Switching Characteristics Guidelines
Testing of the switching parameters is modeled after testing methods specified by MIL-M-38510/605. All devices are 100%
functionally tested. Since many internal timing parameters cannot be measured directly, they are derived from benchmark
timing patterns. The following guidelines reflect worst-case values over the recommended operating conditions. For more
detailed, more precise, and more up-to-date timing information, use the values provided by the timing calculator and used
in the simulator.
Notes:
1. The CLB K to Q delay (TCKO, #8) of any CLB, plus the shortest possible interconnect delay, is always longer than the Data
In hold time requirement (TCKDI, #5) of any CLB on the same die.
2. TILO, TQLO and TICK are specified for 4-input functions. For 5-input functions or base FGM functions, each of these
specifications for the XC3100L family increase by 0.35 ns (-3) and 0.29 ns (-2).
Speed Grade
-3
-2
Description
Symbol
Min
Max
Min
Max
Units
Combinatorial Delay
Logic Variables A, B, C, D, E, to outputs X or Y
1
TILO
2.7
2.2
ns
Sequential delay
Clock k to outputs X or Y
Clock k to outputs X or Y when Q is returned
through function generators F or G to drive X or Y
8TCKO
TQLO
2.1
4.3
1.7
3.5
ns
Set-up time before clock K
Logic Variables
A, B, C, D, E
Data In
DI
Enable Clock
EC
Reset Direct Inactive
RD
2
4
6
TICK
TDICK
TECCK
2.1
1.4
2.7
1.0
1.8
1.3
2.5
1.0
ns
Hold Time after clock K
Logic Variables
A, B, C, D, E
Data In
DI
Enable Clock
EC
3
5
7
TCKI
TCKDI
TCKEC
0
0.9
0.7
0
0.9
0.7
ns
Clock
Clock High time
Clock Low time
Max. flip-flop toggle rate
11
12
TCH
TCL
FCLK
1.6
270
1.3
325
ns
MHz
Reset Direct (RD)
RD width
delay from RD to outputs X or Y
13
9
TRPW
TRIO
2.7
3.1
2.3
2.7
ns
Global Reset (RESET Pad)
RESET width (Low)
(XC3142L)
delay from RESET pad to outputs X or Y
TMRW
TMRQ
12.0
ns
Advance
Product Obsolete or Under Obsolescence
相关PDF资料 |
PDF描述 |
|---|---|
| HSC65DRYH-S13 | CONN EDGECARD 130PS .100 EXTEND |
| FMC26DRYI | CONN EDGECARD 52POS DIP .100 SLD |
| ESC50DTES | CONN EDGECARD 100POS .100 EYELET |
| XC3064L-8TQ144I | IC FPGA 3.3V I-TEMP 144-TQFP |
| XC2S100-6FG456C | IC FPGA 2.5V C-TEMP 456-FBGA |
相关代理商/技术参数 |
参数描述 |
|---|---|
| XC3090L-8PC84I | 功能描述:IC FPGA 3.3V I-TEMP 84-PLCC RoHS:否 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:XC3000A/L 产品变化通告:XC4000(E,L) Discontinuation 01/April/2002 标准包装:24 系列:XC4000E/X LAB/CLB数:100 逻辑元件/单元数:238 RAM 位总计:3200 输入/输出数:80 门数:3000 电源电压:4.5 V ~ 5.5 V 安装类型:表面贴装 工作温度:-40°C ~ 100°C 封装/外壳:120-BCBGA 供应商设备封装:120-CPGA（34.55x34.55） |
| XC31 | 制造商:TOREX 制造商全称:Torex Semiconductor 功能描述:Temperature Controlled Voltage Regulators |
| XC3100 | 制造商:XILINX 制造商全称:XILINX 功能描述:Logic Cell Array Families |
| XC3100A | 制造商:XILINX 制造商全称:XILINX 功能描述:Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
| XC3100A/L | 制造商:XILINX 制造商全称:XILINX 功能描述:Field Programmable Gate Arrays (XC3000A/L, XC3100A/L) |
发布紧急采购，3分钟左右您将得到回复。