参数资料
| 型号： | XRT72L53IB-F |
| 厂商： | Exar Corporation |
| 文件页数： | 22/467页 |
| 文件大小： | 0K |
| 描述： | IC FRAMER DS3/E3 3CH 272PBGA |
| 产品变化通告： | XRT72Lx Series Obsolescence 02/May/2012 |
| 标准包装： | 40 |
| 控制器类型： | DS3/E3 调帧器 |
| 电源电压： | 3.3V |
| 电流 - 电源： | 190mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 272-BBGA |
| 供应商设备封装： | 272-PBGA（27x27） |
| 包装： | 托盘 |
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á
á THREE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER XRT72L53
PRELIMINARY
REV. P1.1.7
118
This Read/Write bit-field is used to insert errors into
the Framing Alignment octet, FA1 of each outbound
E3 frame. The user may wish to do this for equipment
testing purposes. Prior to transmission, the Transmit
DS3/E3 Framer block reads in the FA1 byte, and per-
forms an XOR operation with it and the contents of
this register. The results of this operation are written
back into the FA1 octet position, in each outbound E3
frame. Consequently, to insure errors are not injected
into the FA1 octet of the outbound E3 frames, the
contents of this register must be set to all “0’s” (the
default value).
2.4.6.24 Transmit E3 FA2 Byte Error Mask Reg-
ister (E3, ITU-T G.832)
This Read/Write bit-field is used to insert errors into
the Framing Alignment octet, FA2 of each outbound
E3 frame. The user may wish to do this for equipment
testing purposes. Prior to transmission, the Transmit
DS3/E3 Framer block reads in the FA2 byte, and per-
forms an XOR operation with it and the contents of
this register. The results of this operation are written
back into the FA2 octet position, in each outbound E3
frame. Consequently, to insure errors are not injected
into the FA2 octet of the outbound E3 frames, the
contents of this register must be set to all "0’s" (the
default value).
2.4.6.25 Transmit E3 BIP-8 Error Mask Register
(E3, ITU-T G.832)
This Read/Write bit-field is used to insert errors into
EM (Error Monitor) octet of each outbound E3 frame.
The user may wish to do this for equipment testing
purposes. Prior to transmission, the Transmit DS3/E3
Framer block reads in the EM byte, and performs an
XOR operation with it and the contents of this regis-
ter. The results of this operation are written back into
the EM octet position, in each outbound E3 frame.
Consequently, to insure errors are not injected into
the EM octet of the outbound E3 frames, the contents
of this register must be set to all "0’s" (the default val-
ue).
2.4.7
Transmit E3 Framer Configuration Regis-
ters (ITU-T G.751)
2.4.7.1
Transmit E3 Configuration Register
(ITU-T G.751)
Bit 7 - TxBIP-4 Enable
TXE3 FA2 ERROR MASK REGISTER (ADDRESS = 0X49)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
TxFA2_Error_Mask_Byte[7:0]
R/W
0
0000
000
TXE3 BIP-8 ERROR MASK REGISTER (ADDRESS = 0X4A)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
TxBIP-8_Error_Mask_Byte[7:0]
R/W
0
0000
000
TXE3 CONFIGURATION REGISTER (ADDRESS = 0X30)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
Tx
BIP-4
Enable
TxASourceSel[1:0]
TxNSourceSel[1:0]
Tx AIS
Enable
Tx LOS
Enable
Tx FAS
Source
Select
R/W
0
0000
000
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