参数资料
| 型号： | XRT72L53IB-F |
| 厂商： | Exar Corporation |
| 文件页数： | 30/467页 |
| 文件大小： | 0K |
| 描述： | IC FRAMER DS3/E3 3CH 272PBGA |
| 产品变化通告： | XRT72Lx Series Obsolescence 02/May/2012 |
| 标准包装： | 40 |
| 控制器类型： | DS3/E3 调帧器 |
| 电源电压： | 3.3V |
| 电流 - 电源： | 190mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 272-BBGA |
| 供应商设备封装： | 272-PBGA（27x27） |
| 包装： | 托盘 |
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XRT72L53
THREE CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER
á
PRELIMINARY
REV. P1.1.7
125
This Reset-upon-Read register, along with the PMON
FEBE Event Count Register - MSB (Address = 0x56)
contains a 16-bit representation of the number of
FEBE Events that have been detected by the Receive
DS3/E3 Framer block, since the last read of these
registers. This register contains the LSB (or Lower-
Byte) value of this 16 bit expression.
2.4.8.9
PMON CP-Bit Error Event Count Regis-
ter - MSB
This Reset-upon-Read register, along with the PMON
CP-Bit Error Count Register - LSB (Address = 0x59)
contains a 16-bit representation of the number of CP-
bit Errors that have been detected by the Receive
DS3/E3 Framer block (within the channel), since the
last read of these registers. This register contains the
MSB (or Upper-Byte) value of this 16 bit expression.
NOTE: This register is only active if the Channel has been
configured to operate in the DS3, C-bit Parity Framing for-
mat.
2.4.8.10 PMON CP-Bit Error Event Count Regis-
ter - LSB
This Reset-upon-Read register, along with the PMON
CP-Bit Error Count Register - MSB (Address = 0x58)
contains a 16-bit representation of the number of CP-
bit Errors that have been detected by the Receive
DS3/E3 Framer block (within the channel), since the
last read of these registers. This register contains the
LSB (or Lower-Byte) value of this 16 bit expression.
NOTE: This register is only active if the Channel has been
configured to operate in the DS3, C-bit Parity Framing for-
mat.
2.4.8.11 PMON Holding Register
Each of the above-defined PMON registers are 16 bit
Reset-upon-Read registers. However, the bi-drection-
al data bus (of the Framer IC) is only 8-bits wide. As a
consequence, whenever the Microprocessor intends
to read a PMON register, there are two things to bear
in mind.
1. This Microprocessor is going to require two read
accesses in order read out the full 16-bit expres-
sion of these PMON registers.
2. The entire 16-bit expression (of a given PMON
register) is going to be reset to 0x0000, immedi-
ately after the Microprocessor has completed its
first read access to the PMON register.
PMON CP-BIT ERROR COUNT REGISTER - MSB (ADDRESS = 0X58)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
CP-Bit Error Count - High Byte
RURRUR
RUR
RURRUR
00
000
PMON CP-BIT ERROR COUNT REGISTER - LSB (ADDRESS = 0X59)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
CP-Bit Error Count - Low Byte
RURRUR
RUR
RURRUR
00
000
PMON HOLDING REGISTER (ADDRESS = 0X6C)
BIT 7BIT 6BIT 5BIT 4BIT 3BIT 2BIT 1BIT 0
PMON Holding Value
RURRUR
RUR
RURRUR
00
000
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