参数资料
| 型号： | XRT83L30IV-F |
| 厂商： | Exar Corporation |
| 文件页数： | 13/78页 |
| 文件大小： | 0K |
| 描述： | IC LIU LH/SH T1/E1 SGL 64TQFP |
| 标准包装： | 160 |
| 类型： | 线路接口装置（LIU） |
| 驱动器/接收器数： | 1/1 |
| 规程： | T1，E1 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-LQFP |
| 供应商设备封装： | 64-TQFP（10x10） |
| 包装： | 托盘 |
| 其它名称： | 1016-1633 XRT83L30IV-F-ND |
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XRT83L30
17
SINGLE-CHANNEL T1/E1/J1 LH/SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
REV. 1.0.1
FUNCTIONAL DESCRIPTION
The XRT83L30 is a fully integrated single channel long-haul and short-haul transceiver intended for T1, J1 or
Hardware mode. The XRT83L30 can receive signals that have been attenuated from 0 to 36dB at 772kHz (0
to 6000 feet cable loss) for T1 and from 0 to 43dB at 1024kHz for E1 systems.
In T1 applications, the XRT83L30 can generate five transmit pulse shapes to meet the short-haul Digital Cross-
connect (DSX-1) template requirement as well as four CSU Line Build-Out (LBO) filters of 0dB, -7.5dB, -15dB
and -22.5dB as required by FCC rules. It also provides programmable transmit output pulse generator that can
be used for output pulse shaping allowing performance improvement over a wide variety of conditions. The
operation and configuration of the XRT83L30 can be controlled through a serial microprocessor Host interface
or, by Hardware control.
MASTER CLOCK GENERATOR
Using a variety of external clock sources, the on-chip frequency synthesizer generates the T1 (1.544MHz) or
E1 (2.048MHz) master clocks necessary for the transmit pulse shaping and receive clock recovery circuit.
There are two master clock inputs MCLKE1 and MCLKT1. In systems where both T1 and E1 master clocks are
available these clocks can be connected to the respective pins.
In systems that have only one master clock source available (E1 or T1), that clock should be connected to both
MCLKE1 and MCLKT1 inputs for proper operation. T1 or E1 master clocks can be generated from 8kHz,
16kHz, 56kHz, 64kHz, 128kHz and 256kHz external clocks under the control of CLKSEL[2:0] inputs according
to Table 1.
NOTE: EQC[4:0] determine the T1/E1 operating mode. See
Table 5 for details.
FIGURE 4. TWO INPUT CLOCK SOURCE
FIGURE 5. ONE INPUT CLOCK SOURCE
MCLKE1
MCLKT1
MCLKOUT
1.544MHz
or
2.048MHz
+/-50ppm
1.544MHz
+/-50ppm
Two Input Clock Sources
MCLKE1
MCLKT1
MCLKOUT
1.544MHz
or
2.048MHz
One Input Clock Source
Input Clock Options
8kHz
16kHz
56kHz
64kHz
128kHz
256kHz
1.544MHz
2.048MHz
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PDF描述 |
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