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参数资料
| 型号： | ZL50418/GKC |
| 厂商： | ZARLINK SEMICONDUCTOR INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, LAN SWITCHING CIRCUIT, PBGA553 |
| 封装： | 37.50 X 37.50 MM, 2.33 MM HEIGHT, MS-034, HSBGA-553 |
| 文件页数： | 137/155页 |
| 文件大小： | 1928K |
| 代理商： | ZL50418/GKC |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页当前第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页
ZL50418
Data Sheet
82
Zarlink Semiconductor Inc.
CMD_STATUS_REG
Width
Access
Address
CPU interface commands and status
8-bit
R/W
4
Default: 00
Bit #
Name
Type
Description
[0]
CMD_CONTROL_F
RAME_TX_DONE
W
Set Control Frame Receive buffer ready after CPU writes a
complete frame into the buffer. This bit is self-cleared.
STATUS_CONTRO
L_FRAME_TX_RDY
R
Control Frame receive buffer ready, CPU can write a new frame
1 – CPU can write a new control command
0 – CPU has to wait until this bit is 1 to write a new control
command
[1]
CMD_CONTROL_F
RAME_BUF1_RX_
DONE
W
Set Control Frame Transmit buffer1 ready after CPU reads out a
complete frame from the buffer. This bit is self-cleared.
STATUS_CONTRO
L_FRAME_RX_BUF
1_RDY
R
Control Frame transmit buffer1 ready for CPU to read
1 – CPU can read a new control command 1
0 – CPU has to wait until this bit is 1 to read a new control
command
[2]
CMD_CONTROL_F
RAME_BUF2_RX_
DONE
W
Set Control Frame Transmit buffer2 ready after CPU reads out a
complete frame from the buffer. This bit is self-cleared.
STATUS_CONTRO
L_FRAME_RX_BUF
2_RDY
R
Control Frame transmit buffer2 ready for CPU to read
1 – CPU can read a new control command 2
0 – CPU has to wait until this bit is 1 to read a new control
command
[3]
CMD_CPU_FRAME
_TX_DONE_AND_F
LUSH
W
Set this bit to indicate that the CPU received a whole Ethernet
frame (transmit FIFO frame receive done), and flushed the rest of
frame fragment, if occurs. This bit is self-cleared.
STATUS_CPU_FRA
ME_TX_BUF_RDY
R
Transmit FIFO has data for CPU to read (TXFIFO_RDY)
[4]
CMD_LAST_BYTE_
WRITE
W
Set this bit to indicate that the following Write to the Receive FIFO
is the last one (EOF). This bit is self-cleared.
STATUS_CPU_FRA
ME_RX_BUF_RDY
R
Receive FIFO has space for incoming CPU Ethernet frame
(RXFIFO_SPOK)
[5]
CMD_RESTART_R
X_FIFO
W
Set this bit to re-start the data that is sent from the CPU to Receive
FIFO (re-align). This feature can be used for software debug. For
normal operation must be '0'.
STATUS_CPU_FRA
ME_TX_EOF
R
Transmit FIFO End Of Frame (TXFIFO_EOF)
[7:6]
RSVD
R/W
Reserved
Register Table 5 - 4, CMD_STATUS_REG
相关PDF资料 |
PDF描述 |
|---|---|
| ZL50418GKG2 | DATACOM, LAN SWITCHING CIRCUIT, PBGA553 |
| ZLW-2-B | 1 MHz - 1000 MHz RF/MICROWAVE DOUBLE BALANCED MIXER, 9.5 dB CONVERSION LOSS-MAX |
| ZMG71W | SINGLE COLOR LED, GREEN |
| ZMM5228/D1 | 3.9 V, 0.5 W, SILICON, UNIDIRECTIONAL VOLTAGE REGULATOR DIODE |
| ZMM5242/D1 | 12 V, 0.5 W, SILICON, UNIDIRECTIONAL VOLTAGE REGULATOR DIODE |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ZL51B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL56B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL5V1B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL5V6B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL60001 | 制造商:ZARLINK 制造商全称:Zarlink Semiconductor Inc 功能描述:High speed 2.5 Gbps 850 nm VCSEL |
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