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参数资料
| 型号： | ZL50418/GKC |
| 厂商： | ZARLINK SEMICONDUCTOR INC |
| 元件分类： | 网络接口 |
| 英文描述： | DATACOM, LAN SWITCHING CIRCUIT, PBGA553 |
| 封装： | 37.50 X 37.50 MM, 2.33 MM HEIGHT, MS-034, HSBGA-553 |
| 文件页数： | 65/155页 |
| 文件大小： | 1928K |
| 代理商： | ZL50418/GKC |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页当前第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页
ZL50418
Data Sheet
17
Zarlink Semiconductor Inc.
F4, F5, G4, G5, H4,
H5, J4, J5, K4, K5, L4,
L5, M4, M5, N4, N5,
G3, H1, H2, H3, J1, J2,
J3, K1, K2, K3, L1, L2,
L3, M1, M2, M3, U4,
U5, V4, V5, W4, W5,
Y4, Y5, AA4, AA5,
AB4, AB5, AC4, AC5,
AD4, AD5, W1, Y1, Y2,
Y3, AA1, AA2, AA3,
AB1, AB2, AB3, AC1,
AC2, AC3, AD1, AD2,
AD3
LB_D[63:0]
I/O-TS with weak
internal pull-up
Frame Bank B– Data Bit [63:0]
N3, N2, N1, P3, P2,
P1, R5, R4, R3, R2,
R1, T5, T4, T3, T2, T1,
W3, W2
LB_A[20:3]
Output
Frame Bank B – Address Bit [20:3]
V1
LB_ADSC#
Output with weak
internal pull-up
Frame Bank B Address Status Control
G1
LB_CLK
Output with weak
internal pull-up
Frame Bank B Clock Input
V3
LB_WE#
Output with weak
internal pull-up
Frame Bank B Write Chip Select for
one layer SRAM configuration
P4
LB_WE0#
Output with weak
internal pull-up
Frame Bank B Write Chip Select for
lower layer of two layer SRAM
configuration
P5
LB_WE1#
Output with weak
internal pull-up
Frame Bank B Write Chip Select for
upper layer of two layers SRAM
configuration
V2
LB_OE#
Output with weak
internal pull-up
Frame Bank B Read Chip Select for
one layer SRAM configuration
U1
LB_OE0#
Output with weak
internal pull-up
Frame Bank B Read Chip Select for
lower layer of two layers SRAM
configuration
U2
LB_OE1#
Output with weak
internal pull-up
Frame Bank B Read Chip Select for
upper layer of two layers SRAM
configuration
Fast Ethernet Access Ports [15:0] RMII
R28
M_MDC
Output
MII Management Data Clock –
(Common for all MII Ports [15:0])
P28
M_MDIO
I/O-TS with weak
internal pull-up
MII Management Data I/O – (Common
for all MII Ports –[15:0]))
Ball No(s)
Symbol
I/O
Description
相关PDF资料 |
PDF描述 |
|---|---|
| ZL50418GKG2 | DATACOM, LAN SWITCHING CIRCUIT, PBGA553 |
| ZLW-2-B | 1 MHz - 1000 MHz RF/MICROWAVE DOUBLE BALANCED MIXER, 9.5 dB CONVERSION LOSS-MAX |
| ZMG71W | SINGLE COLOR LED, GREEN |
| ZMM5228/D1 | 3.9 V, 0.5 W, SILICON, UNIDIRECTIONAL VOLTAGE REGULATOR DIODE |
| ZMM5242/D1 | 12 V, 0.5 W, SILICON, UNIDIRECTIONAL VOLTAGE REGULATOR DIODE |
相关代理商/技术参数 |
参数描述 |
|---|---|
| ZL51B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL56B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL5V1B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL5V6B | 制造商:YEASHIN 制造商全称:YEASHIN 功能描述:500 mW DO-35 Hermetically Sealed Glass Zener Voltage Regulators |
| ZL60001 | 制造商:ZARLINK 制造商全称:Zarlink Semiconductor Inc 功能描述:High speed 2.5 Gbps 850 nm VCSEL |
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