参数资料
| 型号： | A3PN060-Z1VQG100I |
| 厂商： | Microsemi SoC |
| 文件页数： | 48/114页 |
| 文件大小： | 0K |
| 描述： | IC FPGA NANO 60K GATES 100-VQFP |
| 标准包装： | 90 |
| 系列： | ProASIC3 nano |
| RAM 位总计： | 18432 |
| 输入/输出数： | 71 |
| 门数： | 60000 |
| 电源电压： | 1.425 V ~ 1.575 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-VQFP（14x14） |
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ProASIC3 nano Flash FPGAs
Revision 11
2-25
3.3 V LVCMOS Wide Range
Table 2-33 Minimum and Maximum DC Input and Output Levels for 3.3 V LVCMOS Wide Range
3.3 V LVCMOS
Wide Range
Equivalent
Software
Default
Drive
Strength
Option3
VIL
VIH
VOL
VOH
IOL
IOH
IIL1
IIH2
Drive Strength
Min.
V
Max.
V
Min.
V
Max.
V
Max.
V
Min.
VmA mA
A4
100 A
2 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
100 A
4 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
100 A
6 mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
100 A
8mA
–0.3
0.8
2
3.6
0.2
VDD – 0.2
100 100
10
Notes:
1. IIL is the input leakage current per I/O pin over recommended operation conditions where –0.3 V < VIN < VIL.
2. IIH is the input leakage current per I/O pin over recommended operating conditions VIH < VIN < VCCI. Input current is
larger when operating outside recommended ranges.
3. The minimum drive strength for any LVCMOS 3.3 V software configuration when run in wide range is ±100 A. Drive
strength displayed in the software is supported for normal range only. For a detailed I/V curve, refer to the IBIS models.
4. Currents are measured at 85°C junction temperature.
5. All LVMCOS 3.3 V software macros support LVCMOS 3.3 V Wide Range, as specified in the JESD8-B specification.
6. Software default selection highlighted in gray.
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PDF描述 |
|---|---|
| A3PN060-1VQ100I | IC FPGA NANO 60K GATES 100-VQFP |
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参数描述 |
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