参数资料
| 型号： | AD9510BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 2/56页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK DIST 8OUT PLL 64LFCSP |
| 标准包装： | 1 |
| 类型： | 扇出缓冲器（分配），除法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:8 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.2GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
| 配用： | AD9510-VCO/PCBZ-ND - BOARD EVALUATION FOR AD9510 AD9510/PCBZ-ND - BOARD EVALUATION FOR AD9510 |
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AD9510
Data Sheet
Rev. B | Page 10 of 56
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CLK1 = 245.76 MHz, OUT = 122.88 MHz
Divide Ratio = 2
At 10 Hz Offset
118
dBc/Hz
At 100 Hz Offset
127
dBc/Hz
At 1 kHz Offset
137
dBc/Hz
At 10 kHz Offset
147
dBc/Hz
At 100 kHz Offset
154
dBc/Hz
At 1 MHz Offset
156
dBc/Hz
>10 MHz Offset
158
dBc/Hz
CLK1-TO-CMOS ADDITIVE PHASE NOISE
Distribution Section only, does not include
PLL or external VCO/VCXO
CLK1 = 245.76 MHz, OUT = 245.76 MHz
Divide Ratio = 1
At 10 Hz Offset
110
dBc/Hz
At 100 Hz Offset
121
dBc/Hz
At 1 kHz Offset
130
dBc/Hz
At 10 kHz Offset
140
dBc/Hz
At 100 kHz Offset
145
dBc/Hz
At 1 MHz Offset
149
dBc/Hz
>10 MHz Offset
156
dBc/Hz
CLK1 = 245.76 MHz, OUT = 61.44 MHz
Divide Ratio = 4
At 10 Hz Offset
122
dBc/Hz
At 100 Hz Offset
132
dBc/Hz
At 1 kHz Offset
143
dBc/Hz
At 10 kHz Offset
152
dBc/Hz
At 100 kHz Offset
158
dBc/Hz
At 1 MHz Offset
160
dBc/Hz
>10 MHz Offset
162
dBc/Hz
CLK1 = 78.6432 MHz, OUT = 78.6432 MHz
Divide Ratio = 1
At 10 Hz Offset
122
dBc/Hz
At 100 Hz Offset
132
dBc/Hz
At 1 kHz Offset
140
dBc/Hz
At 10 kHz Offset
150
dBc/Hz
At 100 kHz Offset
155
dBc/Hz
At 1 MHz Offset
158
dBc/Hz
>10 MHz Offset
160
dBc/Hz
CLK1 = 78.6432 MHz, OUT = 39.3216 MHz
Divide Ratio = 2
At 10 Hz Offset
128
dBc/Hz
At 100 Hz Offset
136
dBc/Hz
At 1 kHz Offset
146
dBc/Hz
At 10 kHz Offset
155
dBc/Hz
At 100 kHz Offset
161
dBc/Hz
>1 MHz Offset
162
dBc/Hz
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PDF描述 |
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参数描述 |
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