参数资料
| 型号： | AD9510BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 47/56页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK DIST 8OUT PLL 64LFCSP |
| 标准包装： | 1 |
| 类型： | 扇出缓冲器（分配），除法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:8 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 1.2GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 托盘 |
| 配用： | AD9510-VCO/PCBZ-ND - BOARD EVALUATION FOR AD9510 AD9510/PCBZ-ND - BOARD EVALUATION FOR AD9510 |
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Data Sheet
AD9510
Rev. B | Page 51 of 56
Reg.
Addr.
(Hex) Bit(s) Name
Description
[3:0] Divider high
Number of clock cycles divider output stays high.
48
OUT0
4A
OUT1
4C
OUT2
4E
OUT3
50
OUT4
52
OUT5
54
OUT6
56
OUT7
[7:4] Divider low
Number of clock cycles divider output stays low.
48
OUT0
4A
OUT1
4C
OUT2
4E
OUT3
50
OUT4
52
OUT5
54
OUT6
56
OUT7
[3:0] Phase offset
Phase offset (default = 0000b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
[4]
Start
Selects start high or start low (default = 0b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
[5]
Force
Forces individual outputs to the state specified in start (see the previous section of this table). This
function requires that Nosync (see the next section of this table) also be set (default = 0b).
49
OUT0
4B
OUT1
4D
OUT2
4F
OUT3
51
OUT4
53
OUT5
55
OUT6
57
OUT7
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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