参数资料
型号: AD9520-4/PCBZ
厂商: Analog Devices Inc
文件页数: 2/80页
文件大小: 0K
描述: BOARD EVAL FOR AD9520-4
设计资源: Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121)
Phase Coherent FSK Modulator (CN0186)
AD9520 Eval Brd Schematic
AD9520 BOM
标准包装: 1
主要目的: 计时,时钟发生器
嵌入式:
已用 IC / 零件: AD9520-4
主要属性: 1.4 ~ 1.8 GHz 输出频率
次要属性: 接受 CMOS、LVDS 或者最高 250 MHz 的 LVPECL 基准
已供物品:
产品目录页面: 776 (CN2011-ZH PDF)
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AD9520-4BCPZ-ND - IC CLOCK GEN 1.6GHZ VCO 64LFCSP
AD9520-4
Data Sheet
Rev. A | Page 10 of 80
CLOCK OUTPUT ADDITIVE PHASE NOISE (DISTRIBUTION ONLY; VCO DIVIDER NOT USED)
Table 6.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CLK-TO-LVPECL ADDITIVE PHASE NOISE
Distribution section only; does not include PLL and VCO
CLK = 1 GHz, Output = 1 GHz
Input slew rate > 1 V/ns
Divider = 1
10 Hz Offset
107
dBc/Hz
100 Hz Offset
117
dBc/Hz
1 kHz Offset
127
dBc/Hz
10 kHz Offset
135
dBc/Hz
100 kHz Offset
142
dBc/Hz
1 MHz Offset
145
dBc/Hz
10 MHz Offset
147
dBc/Hz
100 MHz Offset
150
dBc/Hz
CLK = 1 GHz, Output = 200 MHz
Input slew rate > 1 V/ns
Divider = 5
10 Hz Offset
122
dBc/Hz
100 Hz Offset
132
dBc/Hz
1 kHz Offset
143
dBc/Hz
10 kHz Offset
150
dBc/Hz
100 kHz Offset
156
dBc/Hz
1 MHz Offset
157
dBc/Hz
>10 MHz Offset
157
dBc/Hz
CLK-TO-CMOS ADDITIVE PHASE NOISE
Distribution section only; does not include PLL and VCO
CLK = 1 GHz, Output = 250 MHz
Input slew rate > 1 V/ns
Divider = 4
10 Hz Offset
107
dBc/Hz
100 Hz Offset
119
dBc/Hz
1 kHz Offset
125
dBc/Hz
10 kHz Offset
134
dBc/Hz
100 kHz Offset
144
dBc/Hz
1 MHz Offset
148
dBc/Hz
>10 MHz Offset
154
dBc/Hz
CLK = 1 GHz, Output = 50 MHz
Input slew rate > 1 V/ns
Divider = 20
10 Hz Offset
126
dBc/Hz
100 Hz Offset
133
dBc/Hz
1 kHz Offset
140
dBc/Hz
10 kHz Offset
148
dBc/Hz
100 kHz Offset
157
dBc/Hz
1 MHz Offset
160
dBc/Hz
>10 MHz Offset
163
dBc/Hz
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PDF描述
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