参数资料
型号: AD9552BCPZ
厂商: Analog Devices Inc
文件页数: 32/32页
文件大小: 0K
描述: IC PLL CLOCK GEN LP 32LFCSP
设计资源: Clock Distribution Circuit with Pin-Programmable Output Frequency, Output Logic Levels, and Fanout (CN0152)
标准包装: 1
类型: 时钟发生器
PLL: 带旁路
输入: CMOS,晶体
输出: CMOS,LVDS,LVPECL
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 无/是
频率 - 最大: 900MHz
除法器/乘法器: 是/无
电源电压: 3.135 V ~ 3.465 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 32-VFQFN 裸露焊盘,CSP
供应商设备封装: 32-LFCSP-VQ(5x5)
包装: 托盘
Data Sheet
AD9552
Rev. E | Page 9 of 32
TYPICAL PERFORMANCE CHARACTERISTICS
–20
–30
–40
–50
–60
–70
–80
–90
–100
–110
–120
–130
–140
–150
–160
–170
–180
100
1k
10k
100k
1M
10M
100M
FREQUENCY (Hz)
PH
A
SE
N
O
ISE
(d
B
)
07806-
014
CARRIER 624.988784MHz
0.4009dBm
Figure 3. Phase Noise, Fractional-N, Pin Programmed
(fXTAL = 19.44 MHz, fOUT1 = 625 MHz)
–20
–30
–40
–50
–60
–70
–80
–90
–100
–110
–120
–130
–140
–150
–160
–170
–180
100
1k
10k
100k
1M
10M
100M
FREQUENCY (Hz)
PH
A
SE
N
O
ISE
(d
B
)
07806-
015
CARRIER 624.999995MHz
0.4057dBm
Figure 4. Phase Noise, Fractional-N, Pin Programmed
(fREF = 19.44 MHz, fOUT1 = 625 MHz)
10
0
–10
–20
–30
–40
–50
–60
1k
10k
100k
1M
10M
FREQUENCY OFFSET (Hz)
JI
T
E
R
T
RANS
F
E
R
(
d
B)
07806-
018
–3
–2
–1
0
1
1k
10k
100k
JITTER TRANSFER
JITTER PEAKING
Figure 5. Jitter Transfer and Jitter Peaking
–20
–30
–40
–50
–60
–70
–80
–90
–100
–110
–120
–130
–140
–150
–160
–170
–180
100
1k
10k
100k
1M
10M
100M
FREQUENCY (Hz)
PH
A
SE
N
O
ISE
(d
B
)
07806-
016
CARRIER 622.068199MHz
0.5831dBm
Figure 6. Phase Noise, Integer, SDM Off
(fXTAL = 19.44 MHz, fOUT1 = 622.08 MHz)
–20
–30
–40
–50
–60
–70
–80
–90
–100
–110
–120
–130
–140
–150
–160
–170
–180
100
1k
10k
100k
1M
10M
100M
FREQUENCY (Hz)
PH
A
SE
N
O
ISE
(d
B
)
07806-
017
CARRIER 622.079986MHz
0.3798dBm
Figure 7. Phase Noise, Integer, SDM Off
(fREF = 19.44 MHz, fOUT1 = 622.08 MHz)
35
30
25
20
15
10
5
S
UP
P
L
Y
CURRE
NT
(
mA)
100
1k
FREQUENCY (MHz)
07806-
019
LVPECL
LVDS (WEAK)
LVDS (STRONG)
Figure 8. Supply Current vs. Output Frequency,
LVPECL and LVDS (15 pF Load)
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