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参数资料
| 型号： | AD9553/PCBZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 18/44页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR AD9553 |
| 设计资源： | AD9553 Eval Brd BOM AD9553 Eval Brd Schematic |
| 标准包装： | 1 |
| 主要目的： | 计时，时钟缓冲器 / 驱动器 / 接收器 / 变换器 |
| 已用 IC / 零件： | AD9553 |
| 已供物品： | 板 |
| 相关产品： | AD9553BCPZ-ND - IC INTEGER-N CLCK GEN 32LFCSP AD9553BCPZ-REEL7-ND - IC INTEGER-N CLCK GEN 32LFCSP |
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AD9553
Rev. A | Page 25 of 44
PIN
DECODE
LOGIC
OM[2:0]
0
1
3
DRIVER
OUT1
OUTPUT
CONTROL
OUTPUT
CONTROL
2
3
DRIVE
STRENGTH
REGISTER 0x32
REGISTER 0x34
MODE
CONTROL
ENABLE
SPI
CONTROL
POWER-
DOWN
CMOS
POLARITY
DRIVE
STRENGTH
MODE
CONTROL
POWER-
DOWN
CMOS
POLARITY
2
DRIVER
OUT2
2
0
1
2
3
MODE
CONTROL
0
REGISTER
DEFAULT VALUES
SHOWN IN RED
101
00
0
1
0
101
00
0
1
3
ENABLE
SPI
CONTROL
BITS
[5:3]
BITS
[2:1]
BIT 0
BIT 7
BIT 6
BITS
[5:3]
BITS
[2:1]
BIT 0
BIT 7
BIT 6
08565-
104
Figure 31. Output Driver Control
Output Driver Polarity (CMOS)
When the mode control bits indicate the CMOS logic family
(see Table 19), the user has control of the logic polarity asso-
ciated with each CMOS output pin. Driver polarity defines how
the logic level (Logic 1 or Logic 0) at a CMOS output pin relates
to the logic state (logic true or logic false). Normal polarity
equates Logic 1/Logic 0 to logic true/logic false, while inverted
polarity equates Logic 0/Logic 1 to logic true/logic false. Bit[2]
of the OUT1 and OUT2 driver control registers establishes the
CMOS polarity of the associated output driver (see Figure 31).
Output Drive Strength (CMOS or LVDS)
When the mode bits indicate the CMOS or LVDS logic family
(see Table 19), the user can select whether the output driver
uses weak or strong drive capability. Bit 7 of the OUT1 and
OUT2 driver control registers control the drive strength of
the associated output driver (see Figure 31). In the case of the
CMOS family, the strong setting allows for driving increased
capacitive loads. In the case of the LVDS family, the nominal
weak and strong drive currents are 3.5 mA and 7 mA, respectively.
Output Power Down
The AD9553 supports the option of independent power-down
of the output drivers. Bit 6 of the OUT1 and OUT2 driver control
registers controls the power-down function (see Figure 31). When
Bit 6 is Logic 0, the associated output driver is active. When Bit 6 is
Logic 1, the associated output driver is in power-down mode.
相关PDF资料 |
PDF描述 |
|---|---|
| ECE-T2WA561EA | CAP ALUM 560UF 450V 20% SNAP |
| 5503995-1 | CABLE ASSEM FIBER ST-ST 1 METER |
| M1BXK-2436J | IDC CABLE - MSR24K/MC24G/X |
| 5504970-5 | CABLE ASSEM FIBER SC-SC 10METER |
| AD812AR-EBZ | BOARD EVAL FOR AD812AR |
相关代理商/技术参数 |
参数描述 |
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| AD9554BCPZ | 功能描述:IC CLOCK TRANSLATOR 8OUT 72LFCSP 制造商:analog devices inc. 系列:- 包装:托盘 零件状态:有效 PLL:是 主要用途:以太网，SONET/SDH，Stratum 输入:CMOS，LVDS 输出:HCSL，LVDS，LVPECL 电路数:1 比率 - 输入:输出:4：8 差分 - 输入:输出:是/是 频率 - 最大值:941MHz 电压 - 电源:1.47 V ~ 1.89 V 工作温度:-40°C ~ 85°C 安装类型:表面贴装 封装/外壳:72-VFQFN 裸露焊盘，CSP 供应商器件封装:72-LFCSP-VQ（10x10） 标准包装:1 |
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