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参数资料
型号： AD9959BCPZ
厂商： Analog Devices Inc
文件页数： 5/44页
文件大小： 0K
描述： IC DDS QUAD 10BIT DAC 56LFCSP
产品培训模块： Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action
Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter
Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction
Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter
Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator
设计资源： Phase Coherent FSK Modulator (CN0186)
标准包装： 1
分辨率（位）： 10 b
主 fclk： 500MHz
调节字宽（位）： 32 b
电源电压： 1.71 V ~ 1.96 V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 56-VFQFN 裸露焊盘，CSP
供应商设备封装： 56-LFCSP-VQ（8x8）
包装： 托盘
产品目录页面： 552 (CN2011-ZH PDF)
AD9959
Rev. B | Page 13 of 44
–170
–160
–150
–140
–130
–120
–110
–100
10
100
1k
10k
100k
1M
10M
FREQUENCY OFFSET (Hz)
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
05
246
-03
4
75.1MHz
100.3MHz
40.1MHz
15.1MHz
Figure 16. Residual Phase Noise (SSB) with fOUT = 15.1 MHz, 40.1 MHz,
75.1 MHz, 100.3 MHz; fCLK = 500 MHz with REFCLK Multiplier Bypassed
–70
–170
10
10M
05
24
6-
0
35
FREQUENCY OFFSET (Hz)
PH
A
S
E
N
O
ISE
(
d
B
c/
H
z)
–80
–90
–100
–110
–120
–130
–140
–150
–160
100
1k
10k
100k
1M
100.3MHz
75.1MHz
15.1MHz
40.1MHz
Figure 17. Residual Phase Noise (SSB) with fOUT = 15.1 MHz, 40.1 MHz,
75.1 MHz, 100.3 MHz; fCLK = 500 MHz with REFCLK Multiplier = 5×
–70
–170
10
10M
05
24
6-
0
36
FREQUENCY OFFSET (Hz)
P
HAS
E
NO
IS
E
(
d
Bc/
H
z)
–80
–90
–100
–110
–120
–130
–140
–150
–160
100
1k
10k
100k
1M
100.3MHz
75.1MHz
15.1MHz
40.1MHz
Figure 18. Residual Phase Noise (SSB) with fOUT = 15.1 MHz, 40.1 MHz,
75.1 MHz,100.3 MHz; fCLK = 500 MHz with REFCLK Multiplier = 20×
–60
–85
25.3
200.3
05
24
6-
0
37
FREQUENCY OF COUPLING SPUR (MHz)
CHANN
E
L
I
S
O
L
A
T
IO
N
(
d
Bc)
–65
–70
–75
–80
50.3
75.3
100.3
125.3
150.3
175.3
SEPARATE DAC POWER PLANES
SINGLE DAC POWER PLANE
Figure 19. Channel Isolation at 500 MSPS Operation; Conditions are Channel
of Interest Fixed at 110.3 MHz, the Other Channels Are Frequency Swept
600
0
500
05
24
6-
0
38
REFERENCE CLOCK FREQUENCY (MHz)
TO
TA
L
P
O
W
E
R
D
IS
S
IP
A
T
IO
N
(
m
W
) 500
400
300
200
100
450
400
350
300
250
200
150
100
50
3 CHANNELS ON
4 CHANNELS ON
2 CHANNELS ON
1 CHANNEL ON
Figure 20. Power Dissipation vs. Reference Clock Frequency vs. Channel(s)
Power On/Off
–45
–75
1.1
05
24
6-
04
5
fOUT (MHz)
S
F
DR
(
d
B
c)
–50
–55
–60
–65
–70
15.1
40.1
75.1
100.3
200.3
SFDR AVERAGED
Figure 21. Averaged Channel SFDR vs. fOUT
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PDF描述
VE-2WT-IY-F2 CONVERTER MOD DC/DC 6.5V 50W
VE-2WR-IY-F4 CONVERTER MOD DC/DC 7.5V 50W
VE-2WR-IY-F1 CONVERTER MOD DC/DC 7.5V 50W
VE-2WP-IY-F3 CONVERTER MOD DC/DC 13.8V 50W
VE-2WN-IY-F2 CONVERTER MOD DC/DC 18.5V 50W
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参数描述
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