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参数资料
| 型号： | AD9992BBCZRL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 65/92页 |
| 文件大小： | 0K |
| 描述： | IC CCD SGNL PROC 12BIT 105CSPBGA |
| 产品变化通告： | AD9992 Discontinuation 22/Feb/2012 |
| 标准包装： | 2,000 |
| 类型： | CCD 信号处理器，12 位 |
| 输入类型： | 逻辑 |
| 输出类型： | 逻辑 |
| 接口： | 3 线串口 |
| 电流 - 电源： | 27mA |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 105-LFBGA，CSPBGA |
| 供应商设备封装： | 105-CSPBGA（8x8） |
| 包装： | 带卷 (TR) |
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AD9992
Rev. C | Page 68 of 92
Table 27. Standby Mode Operation (Standby Polarities for XV, XSUBCK, GPO Outputs Are Programmable)
I/O Block
OUTCONTROL = Low2
Standby13, 4
AFE
Off
No change
Off
Only REFT, REFB on
Timing Core
Off
No change
Off
On
CLO Oscillator
Off
No change
Off
On
CLO
Low
No change
Low
Running
H1
High-Z
Low
Low (4.3 mA)
H2
High-Z
High
High (4.3 mA)
H3
High-Z
Low
Low (4.3 mA)
H4
High-Z
High
High (4.3 mA)
H5
High-Z
Low
Low (4.3 mA)
H6
High-Z
High
High (4.3 mA)
H7
High-Z
Low
Low (4.3 mA)
H8
High-Z
High
High (4.3 mA)
HL
High-Z
Low
Low (4.3 mA)
RG
High-Z
Low
Low (4.3 mA)
VD
Low
VDHDPOL value
Running
HD
Low
VDHDPOL value
Running
DCLK
Low
Running
Low
Running
DOUT
Low
XV1 to XV24
Low
XSUBCK
Low
GPO1 to GPO8
Low
1 To exit Standby3, write 00 to STANDBY (Address 0x00, Bits [1:0]), and then reset the timing core after 500 μs to guarantee proper settling of the oscillator and external crystal.
2 Standby3 mode takes priority over OUTCONTROL for determining the output polarities.
3 These polarities assume OUTCONTROL = high because OUTCONTROL = low takes priority over Standby1 and Standby2.
4 Standby1 and Standby2 set H and RG drive strength to minimum value (4.3 mA).
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PDF描述 |
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参数描述 |
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| AD9993BBCZRL | 功能描述:IC MIXED-SIGNAL FRONT END 196BGA 制造商:analog devices inc. 系列:- 包装:带卷（TR） 零件状态:在售 类型:ADC，DAC 输入类型:LVDS 输出类型:LVDS 接口:SPI 电流 - 电源:- 工作温度:- 安装类型:表面贴装 封装/外壳:196-LFBGA，CSPBGA 供应商器件封装:196-CSPBGA（12x12） 标准包装:1,500 |
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