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参数资料
| 型号： | ADSP-BF524KBCZ-4 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 56/88页 |
| 文件大小： | 0K |
| 描述： | IC DSP CTRLR 400MHZ 289CSPBGA |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | DMA，I²C，PPI，SPI，SPORT，UART，USB |
| 时钟速率： | 400MHz |
| 非易失内存： | ROM（32 kB） |
| 芯片上RAM： | 132kB |
| 电压 - 输入/输出： | 1.8V，2.5V，3.3V |
| 电压 - 核心： | 1.30V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 289-LFBGA，CSPBGA |
| 供应商设备封装： | 289-CSPBGA（12x12） |
| 包装： | 托盘 |
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ADSP-BF522/ADSP-BF523/ADSP-BF524/ADSP-BF525/ADSP-BF526/ADSP-BF527
Table 46. Serial Ports—Enable and Three-State
ADSP-BF522/ADSP-BF524/ADSP-BF526
ADSP-BF523/ADSP-BF525/ADSP-BF527
V DDEXT
1.8V Nominal
V DDEXT
2.5 V or 3.3V Nominal
V DDEXT
1.8V Nominal
V DDEXT
2.5 V or 3.3V Nominal
Parameter
Min
Max
Min
Max
Min
Max
Min
Max
Unit
Switching Characteristics
t DTENE
Data Enable Delay from
0.0
0.0
0.0
0.0
ns
External TSCLKx 1
t DDTTE
Data Disable Delay from
t SCLK +1
t SCLK +1
t SCLK +1
t SCLK +1
ns
External TSCLKx 1
t DTENI
Data Enable Delay from
–2.0
–2.0
–2.0
–2.0
ns
Internal TSCLKx 1
t DDTTI
Data Disable Delay from
t SCLK +1
t SCLK +1
t SCLK +1
t SCLK +1
ns
Internal TSCLKx 1
1
Referenced to drive edge.
TSCLKx
DRIVE EDGE
t DTENE/I
DRIVE EDGE
t DDTTE/I
DTx
Figure 26. Serial Ports — Enable and Three-State
Rev. D
|
Page 56 of 88 | July 2013
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