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参数资料
| 型号： | ADSP-BF527KBCZ-6A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 25/88页 |
| 文件大小： | 0K |
| 描述： | IC DSP 16BIT 600MHZ 208CSPBGA |
| 产品变化通告： | Datasheet Specification Change 14/Dec/2009 |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | DMA，以太网，I²C，PPI，SPI，SPORT，UART，USB |
| 时钟速率： | 600MHz |
| 非易失内存： | ROM（32 kB） |
| 芯片上RAM： | 132kB |
| 电压 - 输入/输出： | 1.8V，2.5V，3.3V |
| 电压 - 核心： | 1.10V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 208-LFBGA，CSPBGA |
| 供应商设备封装： | 208-CSPBGA |
| 包装： | 托盘 |
| 配用： | EVAL-SDP-CB1Z-ND - BOARD EVALUATION FOR SDP-CB1 ADZS-BF527-MPSKIT-ND - BOARD EVAL MEDIA PLAYER BF527 ADZS-BF527-EZLITE-ND - BOARD EVAL ADSP-BF527 |
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ADSP-BF522/ADSP-BF523/ADSP-BF524/ADSP-BF525/ADSP-BF526/ADSP-BF527
Table 10. Signal Descriptions (Continued)
Driver
Signal Name
Port G: GPIO and Multiplexed Peripherals
Type Function
Type 1
PG0/ HWAIT
PG1/ SPISS / SPISEL1
PG2/ SCK
PG3/ MISO / DR0SECA
PG4/ MOSI / DT0SECA
PG5/ TMR1 / PPI_FS2
PG6/ DT0PRIA / TMR2 / PPI_FS3
PG7/ TMR3 / DR0PRIA / UART0TX
PG8/ TMR4 / RFS0A / UART0RX / TACI4
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
I/O
GPIO/ Boot Host Wait 2
GPIO/ SPI Slave Select Input / SPI Slave Select 1
GPIO/ SPI Clock
GPIO/ SPI Master In Slave Out / Sport 0 Alternate Receive Data Secondary
GPIO/ SPI Master Out Slave In / Sport 0 Alternate Transmit Data Secondary
GPIO/ Timer1 / PPI Frame Sync2
GPIO/ SPORT0 Alternate Primary Transmit Data / Timer2 / PPI Frame Sync3
GPIO/ Timer3 / Sport 0 Alternate Receive Data Primary / UART0 Transmit
GPIO/ Timer 4 / Sport 0 Alternate Receive Clock/Frame Sync
C
C
D
C
C
C
C
C
C
/ UART0 Receive / Alternate Capture Input 4
PG9/ TMR5 / RSCLK0A / TACI5
I/O
GPIO/ Timer5 / Sport 0 Alternate Receive Clock
D
/ Alternate Capture Input 5
PG10/ TMR6 / TSCLK0A / TACI6
I/O
GPIO/ Timer 6 / Sport 0 Alternate Transmit
D
/ Alternate Capture Input 6
PG11/ TMR7 / HOST_WR
PG12/ DMAR1 / UART1TXA / HOST_ACK
PG13/ DMAR0 / UART1RXA / HOST_ADDR / TACI2
I/O
I/O
I/O
GPIO/ Timer7 / Host DMA Write Enable
GPIO/ DMA Request 1 / Alternate UART1 Transmit / Host DMA Acknowledge
GPIO/ DMA Request 0 / Alternate UART1 Receive / Host DMA Address / Alternate
C
C
C
Capture Input 2
PG14/ TSCLK0A1 / MDC / HOST_RD
I/O
GPIO/ SPORT0 Alternate 1 Transmit / Ethernet Management Channel Clock
D
/ Host DMA Read Enable
PG15 3 / TFS0A / MII PHYINT / RMII MDINT / HOST_CE I/O
GPIO/ SPORT0 Alternate Transmit Frame Sync / Ethernet / MII PHY Interrupt / RMII C
Management Channel Data Interrupt / Host DMA Chip Enable
Port H: GPIO and Multiplexed Peripherals
PH0/ ND_D0 / MIICRS / RMIICRSDV / HOST_D0
PH1/ ND_D1 / ERxER / HOST_D1
PH2/ ND_D2 / MDIO / HOST_D2
PH3/ ND_D3 / ETxEN / HOST_D3
I/O
I/O
I/O
I/O
GPIO/ NAND D0 / Ethernet MII or RMII Carrier Sense / Host DMA D0
GPIO/ NAND D1 / Ethernet MII or RMII Receive Error / Host DMA D1
GPIO/ NAND D2 / Ethernet Management Channel Serial Data / Host DMA D2
GPIO/ NAND D3 / Ethernet MII Transmit Enable / Host DMA D3
C
C
C
C
PH4/ ND_D4 / MIITxCLK / RMIIREF_CLK / HOST_D4 I/O
GPIO/ NAND D4 / Ethernet MII or RMII Reference Clock / Host D4
C
PH5/ ND_D5 / ETxD0 / HOST_D5
PH6/ ND_D6 / ERxD0 / HOST_D6
PH7/ ND_D7 / ETxD1 / HOST_D7
PH8/ SPISEL4 / ERxD1 / HOST_D8 / TACLK2
I/O
I/O
I/O
I/O
GPIO/ NAND D5 / Ethernet MII or RMII Transmit D0 / Host DMA D5
GPIO/ NAND D6 / Ethernet MII or RMII Receive D0 / Host DMA D6
GPIO/ NAND D7 / Ethernet MII or RMII Transmit D1 / Host DMA D7
GPIO/ Alternate Timer Clock 2 / Ethernet MII or RMII Receive D1 / Host DMA D8
C
C
C
C
/ SPI Slave Select 4
PH9/ SPISEL5 / ETxD2 / HOST_D9 / TACLK3
I/O
GPIO/ SPI Slave Select 5 / Ethernet MII Transmit D2 / Host DMA D9
C
/ Alternate Timer Clock 3
PH10/ ND_CE / ERxD2 / HOST_D10
PH11/ ND_WE / ETxD3 / HOST_D11
PH12/ ND_RE / ERxD3 / HOST_D12
PH13/ ND_BUSY / ERxCLK / HOST_D13
I/O
I/O
I/O
I/O
GPIO/ NAND Chip Enable / Ethernet MII Receive D2 / Host DMA D10
GPIO/ NAND Write Enable / Ethernet MII Transmit D3 / Host DMA D11
GPIO/ NAND Read Enable / Ethernet MII Receive D3 / Host DMA D12
GPIO/ NAND Busy / Ethernet MII Receive Clock / Host DMA D13
C
C
C
C
PH14/ ND_CLE / ERxDV / HOST_D14
I/O
GPIO/ NAND Command Latch Enable / Ethernet MII or RMII Receive Data Valid / C
Host DMA D14
PH15/ ND_ALE / COL / HOST_D15
I/O
GPIO/ NAND Address Latch Enable / Ethernet MII Collision / Host DMA Data 15
Rev. D |
Page 25 of 88 | July 2013
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