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参数资料
型号： ADSP-BF544MBBCZ-5M
厂商： Analog Devices Inc
文件页数： 61/100页
文件大小： 0K
描述： IC DSP 16BIT 533MHZ MDDR 400CBGA
标准包装： 1
系列： Blackfin®
类型： 定点
接口： CAN，SPI，SSP，TWI，UART
时钟速率： 533MHz
非易失内存： 外部
芯片上RAM： 196kB
电压 - 输入/输出： 2.50V，3.30V
电压 - 核心： 1.25V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 400-LFBGA，CSPBGA
供应商设备封装： 400-CSPBGA（17x17）
包装： 托盘
配用： ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
Table 43. Serial Ports—Enable and Three-State
Parameter
Min
Max
Unit
Switching Characteristics
tDTENE
Data Enable Delay from External TSCLKx1
0ns
tDDTTE
Data Disable Delay from External TSCLKx
1, 2
10.0
ns
tDTENI
Data Enable Delay from Internal TSCLKx1
–2.0
ns
tDDTTI
Data Disable Delay from Internal TSCLKx
1, 2
3.0
ns
1 Referenced to drive edge.
2 Applicable to multichannel mode only.
Figure 36. Serial Ports—Enable and Three-State
Table 44. Serial Ports—External Late Frame Sync
Parameter
Min
Max
Unit
Switching Characteristics
tDDTLFSE
Data Delay from Late External TFSx or External RFSx in multi-channel mode with MFD = 01
1, 2
10.0
ns
tDTENLFSE
Data Enable from External RFSx in multi-channel mode with MFD = 01, 2
0ns
1 In multichannel mode, TFSx enable and TFSx valid follow t
DTENLFS and tDDTLFSE.
2 If external RFS/TFS setup to RSCLK/TSCLK > tSCLKE/2, then tDDTE/I and tDTENE/I apply; otherwise tDDTLFSE and tDTENLFS apply.
Figure 37. Serial Ports—External Late Frame Sync
TSCLKx
DTx
DRIVE EDGE
tDDTTE/I
tDTENE/I
DRIVE EDGE
RSCLKx
RFSx
DTx
DRIVE
EDGE
DRIVE
EDGE
SAMPLE
EDGE
EXTERNAL RFSx IN MULTI-CHANNEL MODE
1ST BIT
tHOFSE/I
tDTENLFSE
tDDTLFSE
tSFSE/I
TSCLKx
TFSx
DTx
DRIVE
EDGE
DRIVE
EDGE
SAMPLE
EDGE
LATE EXTERNAL TFSx
1ST BIT
tHOFSE/I
tDDTLFSE
tSFSE/I
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PDF描述
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