参数资料
| 型号： | ADV7391BCPZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 13/108页 |
| 文件大小： | 0K |
| 描述： | IC ENCODER VIDEO W/DAC 32LFCSP |
| 产品变化通告： | ADV734x, ADV739x Feature Improvement |
| 标准包装： | 1 |
| 类型： | 视频编码器 |
| 应用： | 机顶盒，视频播放器，显示器 |
| 电压 - 电源，模拟： | 2.6 V ~ 3.46 V |
| 电压 - 电源，数字： | 1.71 V ~ 1.89 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 32-LFCSP-VQ（5x5） |
| 包装： | 托盘 |
| 配用： | EVAL-ADV7391EBZ-ND - BOARD EVAL FOR ADV7391 ENCODER |
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ADV7390/ADV7391/ADV7392/ADV7393
Data Sheet
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TIMING DIAGRAMS
The following abbreviations are used in Figure 4 to Figure 11:
t9 = clock high time
t10 = clock low time
t11 = data setup time
t12 = data hold time
t13 = control output access time
t14 = control output hold time
In addition, see Table 35 for the ADV7390/ADV7391 pixel port
input configuration and Table 36 for the ADV7392/ADV7393
pixel port input configuration.
Figure 4. SD Input, 8-/10-Bit 4:2:2 YCrCb, Input Mode 000
Figure 5. SD Input, 16-Bit 4:2:2 YCrCb, Input Mode 000
t9
CLKIN
t10
CONTROL
OUTPUTS
HSYNC
VSYNC
Cr2
Cb2
Cr0
Cb0
IN MASTER/SLAVE MODE
IN SLAVE MODE
Y0
Y1
Y2
PIXEL PORT
CONTROL
INPUTS
t12
t11
t13
t14
06234-
002
IN MASTER/SLAVE MODE
IN SLAVE MODE
CLKIN
CONTROL
OUTPUTS
t9
t10
Cr2
Cb2
Cr0
Cb0
Y0
Y1
Y2
Y3
t12
t14
t11
t13
HSYNC
VSYNC
CONTROL
INPUTS
PIXEL PORT
06234-
003
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