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参数资料
| 型号： | ADZS-BF561-MMSKIT |
| 厂商： | Analog Devices Inc |
| 文件页数： | 25/64页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER MULTIMEDIA BF561 |
| 产品培训模块： | Blackfin® Processor Core Architecture Overview Blackfin® Device Drivers Blackfin® Optimizations for Performance and Power Consumption Blackfin® System Services Multimedia Starter Kit |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | DSP：视频 |
| 适用于相关产品： | ADSP-BF561 |
| 所含物品： | 多媒体 SDK 光盘、子板和 ADSP-BF5xx EZ-LITE 评估板 |
| 相关产品： | ADSP-BF561SKBCZ-6V-ND - IC DSP 32BIT 600MHZ 256CSPBGA ADSP-BF561SKBCZ-5V-ND - IC DSP 32BIT 500MHZ 256CSPBGA ADSP-BF561SKBCZ-5A-ND - IC DSP CTLR 32BIT BKFN 256CSPBGA ADSP-BF561SKBCZ-6A-ND - IC DSP CTRLR 32B 600MHZ 256CPBGA ADSP-BF561SBBCZ-5A-ND - IC DSP CTRLR 32B 500MHZ 256CPBGA ADSP-BF561SBBZ500-ND - IC PROCESSOR 500MHZ 297-PBGA ADSP-BF561SBBZ600-ND - IC DSP 32BIT 600MHZ 297-BGA ADSP-BF561SKBZ600-ND - IC DSP 32BIT 600MHZ 297PBGA ADSP-BF561SKBZ500-ND - IC DSP 32BIT 500MHZ 297PBGA ADSP-BF561SKB600-ND - IC DSP CTRLR 32BIT 600MHZ 297BGA 更多... |
| 其它名称： | ADDS-BF561-MMSKIT ADDS-BF561-MMSKIT-ND |
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ADSP-BF561
Asynchronous Memory Write Cycle Timing
Table 19. Asynchronous Memory Write Cycle Timing
Parameter
Min
Max
Unit
Timing Requirements
t SARDY
t HARDY
ARDY Setup Before CLKOUT
ARDY Hold After CLKOUT
4.0
0.0
ns
ns
Switching Characteristics
t DDAT
t ENDAT
t DO
t HO
DATA31 –0 Disable After CLKOUT
DATA31 –0 Enable After CLKOUT
Output Delay After CLKOUT 1
Output Hold After CLKOUT 1
1.0
0.8
6.0
6.0
ns
ns
ns
ns
1
Output pins include AMS3 –0, ABE3 –0, ADDR25 –2, DATA31 –0, AOE, AWE.
ACCESS
SETUP
2 CYCLES
PROGRAMMED WRITE
ACCESS 2 CYCLES
EXTENDED
1 CYCLE
HOLD
1 CYCLE
CLKOUT
AMSx
ABE1–0
ADDR19–1
AWE
t DO
t DO
ABE, ADDRESS
t HO
t HO
ARDY
t SARDY
t HARDY
DATA15–0
t ENDAT
t SARDY
WRITE DATA
Figure 11. Asynchronous Memory Write Cycle Timing
t DDAT
Rev. E |
Page 25 of 64 |
September 2009
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