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参数资料
| 型号： | ADZS-BF561-MMSKIT |
| 厂商： | Analog Devices Inc |
| 文件页数： | 26/64页 |
| 文件大小： | 0K |
| 描述： | KIT STARTER MULTIMEDIA BF561 |
| 产品培训模块： | Blackfin® Processor Core Architecture Overview Blackfin® Device Drivers Blackfin® Optimizations for Performance and Power Consumption Blackfin® System Services Multimedia Starter Kit |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | DSP：视频 |
| 适用于相关产品： | ADSP-BF561 |
| 所含物品： | 多媒体 SDK 光盘、子板和 ADSP-BF5xx EZ-LITE 评估板 |
| 相关产品： | ADSP-BF561SKBCZ-6V-ND - IC DSP 32BIT 600MHZ 256CSPBGA ADSP-BF561SKBCZ-5V-ND - IC DSP 32BIT 500MHZ 256CSPBGA ADSP-BF561SKBCZ-5A-ND - IC DSP CTLR 32BIT BKFN 256CSPBGA ADSP-BF561SKBCZ-6A-ND - IC DSP CTRLR 32B 600MHZ 256CPBGA ADSP-BF561SBBCZ-5A-ND - IC DSP CTRLR 32B 500MHZ 256CPBGA ADSP-BF561SBBZ500-ND - IC PROCESSOR 500MHZ 297-PBGA ADSP-BF561SBBZ600-ND - IC DSP 32BIT 600MHZ 297-BGA ADSP-BF561SKBZ600-ND - IC DSP 32BIT 600MHZ 297PBGA ADSP-BF561SKBZ500-ND - IC DSP 32BIT 500MHZ 297PBGA ADSP-BF561SKB600-ND - IC DSP CTRLR 32BIT 600MHZ 297BGA 更多... |
| 其它名称： | ADDS-BF561-MMSKIT ADDS-BF561-MMSKIT-ND |
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ADSP-BF561
SDRAM Interface Timing
Table 20. SDRAM Interface Timing
Parameter
Min
Max
Unit
Timing Requirement s
t SSDAT
t HSDAT
DATA Setup Before CLKOUT
DATA Hold After CLKOUT
1.5
0.8
ns
ns
Switching Characteristics
t DCAD
t HCAD
t DSDAT
t ENSDAT
t SCLK
t SCLKH
t SCLKL
Command, ADDR, Data Delay After CLKOUT 1
Command, ADDR, Data Hold After CLKOUT 1
Data Disable After CLKOUT
Data Enable After CLKOUT
CLKOUT Period
CLKOUT Width High
CLKOUT Width Low
0.8
1.0
7.5
2.5
2.5
4.0
4.0
ns
ns
ns
ns
ns
ns
ns
1
Command pins include: SRAS, SCAS, SWE, SDQM, SMS3–0, SA10, SCKE.
SDCLK
t SDCLK
t SDCLKH
DATA (IN)
t SSDAT
t HSDAT
t ENSDAT
t DCAD
t SDCLKL
t DSDAT
t HCAD
DATA (OUT)
t DCAD
CMND ADDR
(OUT)
t HCAD
Figure 12. SDRAM Interface Timing
Rev. E |
Page 26 of 64 |
September 2009
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