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参数资料
| 型号： | AM79C965KCW |
| 厂商： | ADVANCED MICRO DEVICES INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 3 CHANNEL(S), LOCAL AREA NETWORK CONTROLLER, PQFP16 |
| 封装： | PLASTIC, QFP-160 |
| 文件页数： | 99/220页 |
| 文件大小： | 1197K |
| 代理商： | AM79C965KCW |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页当前第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页
AMD
P R E L I M I N A R Y
188
Am79C965
SWITCHING CHARACTERISTICS: GPSI
Notes:
1. CLSN must be asserted for a continuous period of 110 nsec or more. Assertion for less than 110 nsec period may or may
not result in CLSN recognition.
2. RXCRS should meet jitter requirements of IEEE 802.3 specification.
3. CLSN assertion before 51.2
sec will be indicated as a normal collision. CLSN assertion after 51.2 sec will be
considered as a Late Receive Collision.
Parameter
Symbol
Parameter Description
Test Conditions
Min
Max
Unit
Transmit Timing
tGPT1
STDCLK period (802.3 Compliant)
99.99
100.01
ns
tGPT2
STDCLK High Time
40
60
ns
tGPT3
TXDAT and TXEN delay from
↑ STDCLK
0
70
ns
tGPT4
RXCRS setup before
↑ STDCLK (Last Bit)
210
ns
tGPT5
RXCRS hold after
↓ TXEN
0
ns
tGPT6
CLSN active time to trigger collision
(Note 1)
110
ns
tGPT7
CLSN active to
↓ RXCRS to prevent
0
ns
LCAR assertion
tGPT8
CLSN active to
↓ RXCRS for SQE
0
4.0
s
Hearbeat Window
tGPT9
CLSN active to
↑ RXCRS for normal collision
0
51.2
s
Receive Timing
tGPR1
SRDCLK period
(Note 2)
80
120
ns
tGPR2
SRDCLK High Time
(Note 2)
30
80
ns
tGPR3
SRDCLK Low Time
(Note 2)
30
80
ns
tGPR4
RXDAT and RXCRS setup to
↑ SRDCLK
15
ns
tGPR5
RXDAT hold after
↑ SRDCLK
15
ns
tGPR6
RXCRS hold after
↓ SRDCLK
0
ns
tGPR7
CLSN active to first
↑ SRDCLK
(Collision Recognition)
0
ns
tGPR8
CLSN active to
↑ SRDCLK for
(Note 3)
51.2
s
Address Type Designation Bit
tGPR9
CLSN setup to last
↑ SRDCLK for
210
ns
Collision Recognition
tGPR10
CLSN active
110
ns
tGPR11
CLSN inactive setup to first
↑ SRDCLK
300
ns
tGPR12
CLSN inactive hold to last
↑ SRDCLK
300
ns
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