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参数资料
| 型号： | AT83SND1CXXX-ROTUL |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | Single-Chip Flash Microcontroller with MP3 Decoder and Human Interface |
| 中文描述： | 8-BIT, MROM, 40 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | GREEN, TQFP-80 |
| 文件页数： | 116/212页 |
| 文件大小： | 1684K |
| 代理商： | AT83SND1CXXX-ROTUL |
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116
4109J–8051–10/06
AT8xC51SND1C
Figure 15-13.
Command Transmission Flow
15.5.2
Command Receiver
The end of the response reception is signalled to you by the EORI flag in MMINT register. This
flag may generate an MMC interrupt request as detailed in Section "Interrupt", page 122. When
this flag is set, 2 other flags in MMSTA register: RESPFS and CRC7S give a status on the
response received. RESPFS indicates if the response format is correct or not: the size is the one
expected (48 bits or 136 bits) and a valid End bit has been received, and CRC7S indicates if the
CRC7 computation is correct or not. These Flags are cleared when a command is sent to the
card and updated when the response has been received.
User may abort response reading by setting and clearing the CRPTR bit in MMCON0 register
which resets the read pointer to the receive FIFO.
According to the MMC specification delay between a command and a response (formally N
CR
parameter) can not exceed 64 MMC clock periods. To avoid any locking of the MMC controller
when card does not send its response (e.g. physically removed from the bus), user must launch
a time-out period to exit from such situation. In case of time-out user may reset the command
controller and its internal state machine by setting and clearing the CCR bit in MMCON2
register.
This time-out may be disarmed when receiving the response.
15.6
Data Line Controller
The data line controller is based on a 16-Byte FIFO used both by the data transmitter channel
and by the data receiver channel.
Command
Transmission
Load Command in
Buffer
MMCMD = index
MMCMD = argument
Configure Response
RESPEN = X
RFMT = X
CRCDIS = X
Transmit Command
CMDEN = 1
CMDEN = 0
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