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参数资料
| 型号： | AT83SND1CXXX-ROTUL |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | Single-Chip Flash Microcontroller with MP3 Decoder and Human Interface |
| 中文描述： | 8-BIT, MROM, 40 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | GREEN, TQFP-80 |
| 文件页数： | 192/212页 |
| 文件大小： | 1684K |
| 代理商： | AT83SND1CXXX-ROTUL |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页当前第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页
192
4109J–8051–10/06
AT8xC51SND1C
22.4.0.5
Timings
Test conditions: capacitive load on all pins= 50 pF.
Table 159.
SPI Interface Master AC Timing
V
DD
= 2.7 to 3.3 V, T
A
= -40 to +85
°
C
Note:
1. Value of this parameter depends on software.
Symbol
Parameter
Min
Max
Unit
Slave Mode
T
CHCH
Clock Period
2
T
PER
T
CHCX
Clock High Time
0.8
T
PER
T
CLCX
Clock Low Time
0.8
T
PER
T
SLCH
, T
SLCL
SS Low to Clock edge
100
ns
T
IVCL
, T
IVCH
Input Data Valid to Clock Edge
40
ns
T
CLIX
, T
CHIX
Input Data Hold after Clock Edge
40
ns
T
CLOV,
T
CHOV
Output Data Valid after Clock Edge
40
ns
T
CLOX
, T
CHOX
Output Data Hold Time after Clock Edge
0
ns
T
CLSH
, T
CHSH
SS High after Clock Edge
0
ns
T
SLOV
SS Low to Output Data Valid
50
ns
T
SHOX
Output Data Hold after SS High
50
ns
T
SHSL
SS High to SS Low
(1)
T
ILIH
Input Rise Time
2
μ
s
T
IHIL
Input Fall Time
2
μ
s
T
OLOH
Output Rise time
100
ns
T
OHOL
Output Fall Time
100
ns
Master Mode
T
CHCH
Clock Period
2
T
PER
T
CHCX
Clock High Time
0.8
T
PER
T
CLCX
Clock Low Time
0.8
T
PER
T
IVCL
, T
IVCH
Input Data Valid to Clock Edge
20
ns
T
CLIX
, T
CHIX
Input Data Hold after Clock Edge
20
ns
T
CLOV,
T
CHOV
Output Data Valid after Clock Edge
40
ns
T
CLOX
, T
CHOX
Output Data Hold Time after Clock Edge
0
ns
T
ILIH
Input Data Rise Time
2
μ
s
T
IHIL
Input Data Fall Time
2
μ
s
T
OLOH
Output Data Rise time
50
ns
T
OHOL
Output Data Fall Time
50
ns
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PDF描述 |
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参数描述 |
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