参数资料
型号: CDK5571
厂商: Cirrus Logic Inc
文件页数: 8/34页
文件大小: 0K
描述: CDB5571 W/CAPTURE PLUS 2 SYSTEM
标准包装: 1
系列: CapturePLUS™II
ADC 的数量: 1
位数: 16
采样率(每秒): 100k
数据接口: 串行
输入范围: 2.4 ~ 4.2 V
工作温度: -40°C ~ 85°C
已用 IC / 零件: CS5571
已供物品: 2 个板,线缆,CD,电源
产品目录页面: 756 (CN2011-ZH PDF)
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598-1266-5-ND - IC ADC 16BIT 1CH 100KSPS 24SSOP
其它名称: 598-1279
CDK5571-1
3/25/08
10:56
SWITCHING CHARACTERISTICS (CONTINUED)
T A = -40 to +85 °C; V1+ = V2+ = +2.5 V, ±5%; V1- = V2- = -2.5 V, ±5%;
VL - VLR = 3.3 V, ±5%, 2.5 V, ±5%, or 1.8 V, ±5%
Input levels: Logic 0 = 0V = Low; Logic 1 = VD+ = High; CL = 15 pF.
CS5571
Parameter
Symbol
Min
Typ
Max
Unit
Serial Port Timing in SSC Mode (SMODE = VL)
Data hold time after SCLK rising
t 7
-
10
-
ns
Serial Clock (Out)
RDY rising after last SCLK rising
CS falling to MSB stable
First SCLK rising after CS falling
CS hold time (low) after SCLK rising
SCLK, SDO tri-state after CS rising
Pulse Width (low)
Pulse Width (high)
t 8
t 9
t 10
t 11
t 12
t 13
t 14
50
50
-
-
-
10
-
-
-
8
10
8
-
5
-
-
-
-
-
-
-
ns
ns
MCLKs
ns
MCLKs
ns
ns
14.
SDO and SCLK will be high impedance when CS is high. In some systems SCLK and SDO may require pull-down
resistors.
15. SCLK = MCLK/2.
MCLK
t 10
RDY
t 13
CS
t 12
t 7
t 8
t 9
t 14
SCLK(o)
t 11
SDO
MSB
MSB – 1
LSB+1
LSB
Figure 2. SSC Mode - Read Timing, CS falling after RDY falls (Not to Scale)
8
DS768PP1
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PDF描述
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