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参数资料
| 型号： | CORE1553-SA |
| 厂商： | Microsemi SoC |
| 文件页数： | 17/30页 |
| 文件大小： | 0K |
| 描述： | HARDWARE FOR IP CORE1553 |
| 标准包装： | 1 |
| 类型： | FPGA |
| 适用于相关产品： | Core1553 |
| 所含物品： | 板 |
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Core1553BBC MIL-STD-1553B Bus Controller
Table 16 ? Message Block (Continued)
Offset
Contents
Written by Description
6
TSW
BC
Message Transfer Status Word. Provides status information on the message block. The CPU
should clear this field when setting up the message block
15
14
13
12
11:9
8
7
6
5:0
Message Okay
'1': Message completed okay with no errors. May have been retried.
'0': Message failed after all retries completed
No response from RT
RT Signaled Message Error
1553B Error occurred, encoding, parity, too many words, etc.
Number of retry attempts to transmit the message (0-6)
Unexpected bit set in the status word
Got the RT-to-RT RX status word
Got the status word, for RT-to-RT got the TX status word
Number or data words transmitted or received.
Note: '000000' indicates 0 and '100000' indicates 32
7
Reserved
–
15:0
Not Used
v4.0
17
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PDF描述 |
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参数描述 |
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