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参数资料
| 型号： | CORE1553-SA |
| 厂商： | Microsemi SoC |
| 文件页数： | 6/30页 |
| 文件大小： | 0K |
| 描述： | HARDWARE FOR IP CORE1553 |
| 标准包装： | 1 |
| 类型： | FPGA |
| 适用于相关产品： | Core1553 |
| 所含物品： | 板 |
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Core1553BBC MIL-STD-1553B Bus Controller
Word Formats
There are only three types of words in a 1553B message: a command word (CW), a data word (DW), and a status word
(SW). Each 20-bit word consists of a 3-bit sync pattern, 16 bits of data, and a parity bit ( Figure 5 ).
Bit
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
CW
Sync
5
RT Address
1
T/R
5
Sub-address
5
Word Count/Mode Code
1
P
DW
Sync
16
Data
1
P
SW
5
1
1
1
3
1
1
1
1
1
1
Sync
RT Address
Reserved
Figure 5 ? 1553B Word Formats
I/O Signal Descriptions
Table 2 ? 1553B Bus Interface
Name
BUSAINEN
BUSAINP
BUSAINN
BUSBINEN
BUSBINP
BUSBINN
BUSAOUTIN
BUSAOUTP
BUSAOUTN
BUSBOUTIN
BUSBOUTP
BUSBOUTN
6
Type
Out
In
In
Out
In
In
Out
Out
Out
Out
Out
Out
Description
Active high output that enables for the A receiver
Positive data input from the A receiver
Negative data input from the A receiver
Active high output that enables for the B receiver
Positive data input from the bus to the B receiver
Negative data input from the bus to the B receiver
Active high transmitter inhibit for the A transmitter
Positive data output to the bus A transmitter (is held high when no transmission)
Negative data output to the bus A transmitter (is held high when no transmission)
Active high transmitter inhibits the B transmitter
Positive data output to the bus B transmitter (is held high when no transmission)
Negative data output to the bus B transmitter (is held high when no transmission)
v4.0
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