参数资料
| 型号： | CS82C37A96 |
| 厂商： | Intersil |
| 文件页数： | 16/24页 |
| 文件大小： | 0K |
| 描述： | IC CMOS DMA CONTROLLER 44PLCC |
| 标准包装： | 500 |
| 应用： | CMOS DMA 控制器 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 电流 - 电源： | 2mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-LCC（J 形引线） |
| 供应商设备封装： | 44-PLCC |
| 包装： | 带卷 (TR) |
82C37A
AC Electrical Specifications
V CC = +5.0V ± 10%, GND = 0V, T A = 0 o C to +70 o C (C82C37A),
T A = -40 o C to +85 o C (I82C37A),
T A = -55 o C to +125 o C (M82C37A)
82C37A-5
82C37A
82C37A-12
SYMBOL
PARAMETER
MIN
MAX
MIN
MAX
MIN
MAX
UNITS
DMA (MASTER) MODE
(1)TAEL
AEN HIGH from CLK LOW (S1) Delay
-
175
-
105
-
50
ns
Time
(2)TAET
AEN LOW from CLK HIGH (SI) Delay
-
130
-
80
-
50
ns
Time
(3)TAFAB
ADR Active to Float Delay from CLK
-
90
-
55
-
55
ns
HIGH
(4)TAFC
READ or WRITE Float Delay from
-
120
-
75
-
50
ns
CLK HIGH
(5)TAFDB
DB Active to Float Delay from CLK
-
170
-
135
-
90
ns
HIGH
(6)TAHR
(7)TAHS
(8)TAHW
(9)TAK
ADR from READ HIGH Hold Time
DB from ADSTB LOW Hold Time
ADR from WRITE HIGH Hold Time
DACK Valid from CLK LOW
TCY-100
TCL-18
TCY-65
-
-
-
-
170
TCY-75
TCL-18
TCY-65
-
-
-
-
105
TCY-65
TCL-18
TCY-50
-
-
-
-
69
ns
ns
ns
ns
Delay Time
EOP HIGH from CLK HIGH
-
170
-
105
-
90
ns
Delay Time
EOP LOW from CLK HIGH
-
100
-
60
-
35
ns
Delay Time
(10)TASM
(11)TASS
(12)TCH
(13)TCL
(14)TCY
(15)TDCL
ADR Stable from CLK HIGH
DB to ADSTB LOW Setup Time
CLK HIGH Time (Transitions 10ns)
CLK LOW Time (Transitions 10ns)
CLK Cycle Time
CLK HIGH to READ or WRITE LOW
-
TCH-20
70
50
200
-
110
-
-
-
-
190
-
TCH-20
55
43
125
-
60
-
-
-
-
130
-
TCH-20
30
30
80
-
50
-
-
-
-
120
ns
ns
ns
ns
ns
ns
Delay
(16)TDCTR
READ HIGH from CLK HIGH (S4)
-
190
-
115
-
80
ns
Delay Time
(17)TDCTW
WRITE HIGH from CLK HIGH (S4)
-
130
-
80
-
70
ns
Delay Time
(18)TDQ
HRQ Valid from CLK HIGH
-
120
-
75
-
30
ns
Delay Time
(19)TEPH
(20)TEPS
(21)TEPW
EOP Hold Time from CLK LOW (S2)
EOP LOW to CLK LOW Setup Time
EOP Pulse Width
90
40
220
-
-
-
90
25
135
-
-
-
50
0
50
-
-
-
ns
ns
ns
16
FN2967.3
October 25, 2011
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PDF描述 |
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参数描述 |
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