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参数资料
| 型号： | DK-DEV-3C120N |
| 厂商： | Altera |
| 文件页数： | 15/92页 |
| 文件大小： | 0K |
| 描述： | KIT DEV CYCLONE III EP3C120 |
| 产品培训模块： | Cyclone® III FPGA Designing an IP Surveillance Camera Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview |
| 特色产品： | Cyclone? III FPGA Development Kit |
| 标准包装： | 1 |
| 系列： | Cyclone® III |
| 类型： | FPGA |
| 适用于相关产品： | EP3C120 |
| 所含物品： | 开发板、通用电源、缆线和软件 |
| 产品目录页面： | 606 (CN2011-ZH PDF) |
| 相关产品： | EP3C120F484I7-ND - IC CYCLONE III FPGA 120K 484FBGA EP3C120F780I7-ND - IC CYCLONE III FPGA 120K 780FBGA 544-2539-ND - IC CYCLONE III FPGA 120K 780FBGA 544-2538-ND - IC CYCLONE III FPGA 120K 484FBGA 544-2528-ND - IC CYCLONE III FPGA 120K 484FBGA 544-2394-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2393-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2392-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2391-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2390-ND - IC CYCLONE III FPGA 119K 484FBGA 更多... |
| 其它名称： | 544-2444 |
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28 nm Device Portfolio
Arria V GT FPGA Features
Maximum Resource Count for Arria V GT FPGAs (1.1 V, 1.15 V) 1
5AGTC3
5AGTC7
5AGTD3
5AGTD7
ALMs
LEs (K)
Registers
M10K memory blocks
M10K memory (Kb)
MLAB memory (Kb)
Variable-precision DSP blocks
18 x 18 multipliers
58,900
156
235,600
1,051
10,510
961
396
792
91,680
242
366,720
1,366
13,660
1,448
800
1,600
136,880
362
547,520
1,726
17,260
2,098
1,045
2,090
190,240
504
760,960
2,414
24,140
2,906
1,156
2,312
Global clock networks
16
PLLs 2
10
12
12
16
Design security
I/O voltage levels supported (V)
I/O standards supported
3
1.2, 1.5, 1.8, 2.5, 3.0, 3.3
LVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15,
Differential SSTL-18, Differential SSTL-2, Differential HSTL-12, Differential HSTL-15,
Differential HSTL-18, SSTL-15 (I and II), SSTL-18 (I and II), SSTL-2 (I and II),
1.2 V HSTL (I and II), 1.5 V HSTL (I and II), 1.8 V HSTL (I and II)
LVDS transmitter (TX)
LVDS receiver (RX)
70
80
120
136
160
176
160
176
Embedded DPA circuitry
OCT
Programmable drive strength
3
Series and differential
3
Transceiver count
(10.3125 Gbps/6.5536 Gbps) 3
PCIe hard IP blocks (Gen2 x4)
Hard memory controllers 4
4/3
1
2
12/6
2
4
12/6
2
4
20/6
2
4
Memory devices supported
DDR3, DDR2, DDR II+ 5 , QDR II, QDR II+, RLDRAM II, LPDDR 5 , LPDDR2 5
1
2
3
4
5
All data is correct at the time of printing, and may be subject to change without prior notice. For the latest information, please visit www.altera.com .
The PLL count includes general-purpose fractional PLLs and transceiver fractional PLLs.
One pair of 10 Gbps transceiver channels can be configured as three 6 Gbps transceiver channels.
With 16 and 32 bit ECC support.
These memory interfaces are not available as Altera IP.
Altera Product Catalog
?
2013
?
www.altera.com
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