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参数资料
| 型号： | DK-DEV-3C120N |
| 厂商： | Altera |
| 文件页数： | 5/92页 |
| 文件大小： | 0K |
| 描述： | KIT DEV CYCLONE III EP3C120 |
| 产品培训模块： | Cyclone® III FPGA Designing an IP Surveillance Camera Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview |
| 特色产品： | Cyclone? III FPGA Development Kit |
| 标准包装： | 1 |
| 系列： | Cyclone® III |
| 类型： | FPGA |
| 适用于相关产品： | EP3C120 |
| 所含物品： | 开发板、通用电源、缆线和软件 |
| 产品目录页面： | 606 (CN2011-ZH PDF) |
| 相关产品： | EP3C120F484I7-ND - IC CYCLONE III FPGA 120K 484FBGA EP3C120F780I7-ND - IC CYCLONE III FPGA 120K 780FBGA 544-2539-ND - IC CYCLONE III FPGA 120K 780FBGA 544-2538-ND - IC CYCLONE III FPGA 120K 484FBGA 544-2528-ND - IC CYCLONE III FPGA 120K 484FBGA 544-2394-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2393-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2392-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2391-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2390-ND - IC CYCLONE III FPGA 119K 484FBGA 更多... |
| 其它名称： | 544-2444 |
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20 nm Device Portfolio
Arria 10 GT FPGA Features
Arria 10 GT FPGAs: Up to 96 full-duplex optimized transceivers with data rates up to 28 Gbps, and up to 1,150K equivalent
logic elements.
Maximum Resource Count for Arria 10 GT FPGAs 1
10AT090
10AT115
ALMs
LEs (K)
Registers
M20K memory blocks
M20K memory (Mb)
MLAB memory (Mb)
Variable-precision DSP blocks
18 x 19 multipliers
Global clock networks
Regional clock networks
Design security
I/O voltage levels supported (V)
339,620
900
1,358,480
2,423
47
9.2
1,518
3,036
16
32
Bitstream encryption with authentication
1.2, 1.25, 1.35, 1.8, 2.5, 3.0 2
427,200
1,150
1,708,800
2,713
53
12.7
1,518
3,036
16
3 V I/Os Only: 3 V LVTTL, 2.5 V CMOS
DDR and LVDS I/Os: POD12, POD10, Differential POD12, Differential POD10, LVDS, RSDS,
mini-LVDS, LVPECL
I/O standards supported
All I/Os: 1.8 V CMOS, 1.5 V CMOS, 1.2 V CMOS, SSTL-18 (I and II), SSTL-15 (I and II), SSTL-135,
SSTL-125, SSTL-12, HSTL-18 (I and II), HSTL-15 (I and II), HSTL-12 (I and II), HSUL-12,
Differential SSTL-18 (I and II), Differential SSTL-15 (I and II), Differential SSTL-135,
Differential SSTL-125, Differential SSTL-12, Differential HSTL-18 (I and II),
Differential HSTL-15 (I and II), Differential HSTL-12 (I and II), Differential HSUL-12
LVDS channels, 1.6 Gbps (receive/transmit)
Embedded DPA circuitry
OCT
Transceiver count
PCIe hard IP blocks (Gen3)
312
96
4
3
Series, parallel, and differential
312
96
4
Memory devices supported
DDR4, DDR3, DDR2, QDR IV, QDR II+, QDR II+ Xtreme, LPDDR3, LPDDR2, RLDRAM 3, RLDRAM II,
LLDRAM II, HMC
1
2
All data is correct at the time of printing, and may be subject to change without prior notice. For the latest information, please visit www.altera.com .
3.0 V compliant, requires a 3 V power supply.
Altera Product Catalog
?
2013
?
www.altera.com
3
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