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参数资料
| 型号： | DK-DEV-3C120N |
| 厂商： | Altera |
| 文件页数： | 25/92页 |
| 文件大小： | 0K |
| 描述： | KIT DEV CYCLONE III EP3C120 |
| 产品培训模块： | Cyclone® III FPGA Designing an IP Surveillance Camera Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview |
| 特色产品： | Cyclone? III FPGA Development Kit |
| 标准包装： | 1 |
| 系列： | Cyclone® III |
| 类型： | FPGA |
| 适用于相关产品： | EP3C120 |
| 所含物品： | 开发板、通用电源、缆线和软件 |
| 产品目录页面： | 606 (CN2011-ZH PDF) |
| 相关产品： | EP3C120F484I7-ND - IC CYCLONE III FPGA 120K 484FBGA EP3C120F780I7-ND - IC CYCLONE III FPGA 120K 780FBGA 544-2539-ND - IC CYCLONE III FPGA 120K 780FBGA 544-2538-ND - IC CYCLONE III FPGA 120K 484FBGA 544-2528-ND - IC CYCLONE III FPGA 120K 484FBGA 544-2394-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2393-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2392-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2391-ND - IC CYCLONE III FPGA 119K 780FBGA 544-2390-ND - IC CYCLONE III FPGA 119K 484FBGA 更多... |
| 其它名称： | 544-2444 |
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28 nm Device Portfolio
Cyclone V SX SoC Features
Maximum Resource Count for Cyclone V SX SoCs (1.1 V) 1
5CSXC2
5CSXC4
5CSXC5
5CSXC6
ALMs
LEs (K)
Registers
M10K memory blocks
M10K memory (Kb)
MLAB memory (Kb)
Variable-precision DSP blocks
18 x 18 multipliers
Processor cores (ARM Cortex-A9)
9,434
25
37,736
140
1,400
138
36
72
Dual
15,094
40
60,376
270
2,700
231
58
116
Dual
32,075
85
128,300
397
3,972
480
87
174
Dual
41,509
110
166,036
557
5,570
621
112
224
Dual
Global clock networks
16
PLLs (FPGA)
2
PLLs 2 (HPS)
4
3
5
3
6
3
6
3
Design security
I/O voltage levels supported (V)
I/O standards supported
3
1.1, 1.2, 1.5, 1.8, 2.5, 3.3
LVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15, Differential SSTL-18,
Differential SSTL-2, Differential HSTL-12, Differential HSTL-15, Differential HSTL-18, SSTL-15 (I and II),
SSTL-18 (I and II), SSTL-2 (I and II), 1.2 V HSTL (I and II), 1.5 V HSTL (I and II), 1.8 V HSTL (I and II),
HiSpi, SLVS, Sub-LVDS
LVDS channels, 875 Mbps receive,
840 Mbps transmit
35
35
72
72
Embedded DPA circuitry
OCT
Programmable drive strength
–
Series and differential
3
Hard memory controllers (FPGA)
Hard memory controllers (HPS)
Transceivercount(3.125Gbps)
PCIe hard IP blocks (Gen1 x4)
GPIOs (FPGA)
GPIOs (HPS)
3
3
6
2
145
181
1
1
6
2
145
181
1
1
9
2
288
181
1
1
9
2
288
181
1
1
Memory devices supported
DDR3, DDR2, LPDDR2
1
2
3
All data is correct at the time of printing, and may be subject to change without prior notice. For the latest information, please visit www.altera.com.
The PLL count includes general-purpose fractional PLLs and transceiver fractional PLLs.
With 16 and 32 bit ECC support.
Altera Product Catalog
?
2013
?
www.altera.com
23
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