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参数资料
| 型号： | DP83848HSQ/NOPB |
| 厂商： | National Semiconductor |
| 文件页数： | 60/82页 |
| 文件大小： | 0K |
| 描述： | IC TXRX ETHERNET PHYTER 40-LLP |
| 产品培训模块： | PHYTER® Family |
| 标准包装： | 1 |
| 类型： | 收发器 |
| 驱动器/接收器数： | 1/1 |
| 规程： | 以太网 |
| 电源电压： | 3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-WFQFN 裸露焊盘 |
| 供应商设备封装： | 40-LLP-EP（6x6） |
| 包装： | 剪切带 (CT) |
| 配用： | DP83848H-MAU-EK-ND - BOARD EVALUATION DP83848H |
| 其它名称： | *DP83848HSQ/NOPB DP83848HSQCT |
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www.national.com
62
DP
83
848
H
8.2.2 Reset Timing
Note: It is important to choose pull-up and/or pull-down resistors for each of the hardware configuration pins that provide
fast RC time constants in order to latch-in the proper value prior to the pin transitioning to an output driver.
Parameter
Description
Notes
Min
Typ
Max
Units
T2.2.1
Post RESET Stabilization time
prior to MDC preamble for reg-
ister accesses
MDIO is pulled high for 32-bit serial man-
agement initialization
3
s
T2.2.2
Hardware Configuration Latch-
in Time from the Deassertion
of RESET (either soft or hard)
Hardware Configuration Pins are de-
scribed in the Pin Description section
3
s
T2.2.3
Hardware Configuration pins
transition to output drivers
50
ns
T2.2.4
RESET pulse width
X1 Clock must be stable for at min. of 1us
during RESET pulse low time.
1
s
Vcc
Hardware
RESET_N
MDC
32 clocks
Latch-In of Hardware
Configuration Pins
Dual Function Pins
Become Enabled As Outputs
input
output
X1 clock
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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